Устройство для контроля логических блоков

Устройство для контроля логических блоков

Иллюстрации

Показать все

Реферат

 

Изобретение относится к вычислительной технике и может быть использовано для контроля микросхем средней и большой степени интеграции.Цель изобретения - повьппение производительности контроля. Устройство содержит блок Г управления, генератор 2 тестов, коммутатор 3, анализатор 5 сигнатур и мажоритарный блок 4, контролируемые логические блоки 6. В процессе контроля партии из однотипных блоков выявленные бракованные логические блоки автоматически исключаются из процесса контроля, и не требуется повторного контроля. 7 ил., 1 табл. € (Л

СОЮЗ СОВЕТСНИХ

СОЦИАЛИСТИЧЕСНИХ

РЕСПУБЛИН (19) (11) А1 (S1) 4 G 06 F 11/26

ОПИСАНИЕ ИЗОБРЕТЕНИЯ

Н АВТОРСКОМУ СВИДЕТЕЛЬСТВУ

Фиг.1

ГОСУДАРСТВЕННЫЙ НОМИТЕТ СССР

ПО ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТНРЫТИЙ (21) 3898290/24-24 (22) 21.05.85 (46) 23.04.87. Бюл. У 15 (7 1) Минский радиотехнический институт (72) И.Н. Гальцов, А.М. Гринкевич, E.Ñ. Рогальский и А.И. Суходольский (53) 68 1.3(088.8) (56) Авторское свидетельство СССР

1)- 1024924, кл. G 06 F 11/16, 1983.

Авторское свидетельство СССР

11 1188740, 13.11.84. (54) УСТРОЙСТВО ДЛЯ КОНТРОЛЯ ЛОГИЧЕСКИХ БЛОКОВ (57) Изобретение относится к вычислительной технике и может быть использовано для контроля микросхем средней и большой степени интеграции. Цель изобретения — повышение производительности контроля. Устройство содержит блок 1 управления, генератор 2 тестов, коммутатор 3, анализатор 5 сигнатур и мажоритарный блок 4, контролируемые логические блоки 6, В процессе контроля партии из однотипных блоков выявленные бракованные логические блоки автоматически исключаютиз процесса контроля, и не требуя повторного контроля. 7 ил., абл.

1305687

Изобретение относится к вычислительной технике и может быть использовано для контроля логических микросхем средней и большой степени интеграции. 5

Цель изобретения — повышение производительности контроля, На фиг. 1 показана схема устройства; на фиг, 2 — блок управления; на фиг. 3 — генератор тестов; на 10 фиг. 4 — коммутатор; на фиг. 5 — схема реализации коммутатора; на фиг.б— схема мажоритарного блока; на фиг.7 схема анализатора сигнатур.

Устройство содержит блок 1 управ- 15 пения, генератор 2 тестов, коммутатор 3, мажоритарный блок 4, анализатор 5 сигнатур, контролируемые логические блоки 6.

Блок управления содержит элементы 20

ИЛИ 7 и 8, триггеры 9 — 11, генератор

12 синхроимпульсов, элемент НЕ 13, элементы И 14 и 15, вход 16 пуска, вход 17 разрешения, вход .18 начала контроля, вход 19 конца контроля,син25 хровыход 20, выход 21 задания режима работы, выход 22 блокировки.

Генератор тестов содержит узел

23 считывания, узел 24 памяти, буферный регистр 25, узел 26 контроля по 30 четности и элемент И 27, выходы гене1ратора 28.! Коммутатор представляет собой ком-. бинационную схему, имеющую N.M инфор- 5 мационных входов 29.1.1-29.1.И, 29.M. 1-29.M.N (N — число контролируемых выходов одного логического блока

\ (Н1 "16), М вЂ” количество контролируемых логических блоков в партии), М адресных входов 30.1-30.М, группу выходов коммутатора 31.1,1-31.1.3

31.N. 1-31.N.З.

Коммутатор содержит элементы НЕ

32, элементы И 33 — 37, элементы РАВ- у5

НОЗНАЧНОСТЬ 38, элементы ИЛИ 39 - 41, выходы 42 — 49 внутренних ярусов коммутатора.

Мажоритарный блок содержит шифратор 50, дешифратор 51, счетчик 52, группу триггеров 53, узел 54 индикации, выходы 55 узла индикации, вход

56 разрешения, группы входов 57 и

58 шифратора.

Анализатор сигнатур содержит распределитель 59 импульсов, регистр 60 с сумматорами по модулю два, регистр

61 памяти, узел 62 сравнения, узел

63 памяти.

При подаче разрешающего уровня на вход 16 триггеры 9 и 10 устанавливаются в единичное состояние. При этом происходит запуск генератора 12, а через открытый элемент И 14 синхроимпульсы поступают на вход 20 к генератору 2, При поступлении разрешающего уровня по входу 18 от генератора 2 тестов триггер !1 формирует сигнал выского уровня на выходе 22, Одновременно триггер 10 устанавливается в нулевое состояние, запрещая тем самым прохождение синхроимпульсов с выхода генератора 12 через открытый элемент И 14 и разрешая прохождение импульсов через элемент И 15 на вход 21 к блоку

4 и анализатору 5.

При поступлении разрешающего уровня по входу 17 от блока 4 триггер 10 устанавливается в единичное состояние, закрывая эпемент И 15 и открывая элемент И 14 для пропуска синхроимпульсов на вход 20 к генератору 2.

При поступлении сигнала "Канал контроля" на вход 19 триггер 9 блокирует работу генератора 12, а триггеры 10 и 11 обнуляются, и на выходе

22 формируется блокирующий сигнал низкого уровня °

При поступлении синхроимпульса на вход 20 узел 23 формирует адрес узла

24 памяти и сигнал записи в буферный регистр 25. С шины 24 параллельный ° код переписывается в регистр 25 по команде записи °

Узел 26 контроля по четности формирует разрешающий уровень при совпадении выходов узла 24 памяти и ре= гистра 25. При несовпадении выходов узел 26 контроля по четности формирует запрещающий уровень, узел 23 блокируется на текущем адресе и по следующему синхроимпульсу по входу 20 производится повторная запись в регистр 25. Этим же уровнем блокируется формирование разрешающего уровня на выходе 18 элемента И 27.

Разрядность используемой двойной комбинации на выходной шине зависит от количества входов контролируемых логических блоков б. Два старших разряда выходной шины узла 24 выполняют следующие функции. При считывании последней тестовой комбинации появление уровня логического нуля в предпоследнем разряде соответствует выдаче ко31.1.3=(29.3.1h ЗО.ЗA30,4А30.5 А

A 30.6)V(29.4.1А 30.4Л 30.5Л

Л 30.6)V(29.5.1h 30.5 A 30.6)V

V(29.6.1. А 30.6). (6) (8) 31.1.2=(29,2 А 30.2 А 30.1) Ч(29.3.

ЛЗО. 3 Л(30. 1 0+ 30. 2) 1Ч(29. 4 h з 1305687 4 манды "Конец контроля" на выходе 19. оРганизации начальных устанс вок для

Уровень логического нуля в старшем блоков 6. разряде выходной шины узла 24 блоки- Функционирование коммутатора 3 рует формирование разрешающего уров- описывается следующими уравнениями ня на выходе 19. Это необходимо для 5 алгебры логики:

Н-2 )

31. i. t =29. i. 1 А 30. 1Ч(29. i. j Л 30. j А ЗО.k) ), i=1... N; (1) к=2

H-1 )

3.1.i.2 =Ч(29.i. j А 30. j А(8 30. (k-1))), i=1...N; (2)

)о2 кд2

Н Н

31. 1. 3= V (29. i j Л 30. j А 30. (k+1) 7, i 1 .. . 11. (3)

1Я Кдj

Коммутатор 3 в соответствии с пос- A 30.4,А(30. 10+30.2 О+ 30. 3)1Ч тупающими на группу его адресных вхо- Ч(29.5.1 Л 30.5A(30.10+. 30.20+ дов 30. 1-30.М кодовыми комбинациями O ЗО.ЗУ 30.4)1; (5) производит подключение выходов определенных логических блоков 6 к своим трем группам выходов. Кодовые комбинации, поступающие на группу адресных входов 30.1-30.М, могут содержать20 либо все нули (тогда на выходах

31 ° 1.1-31.N.З вЂ” все нули), либо три Шифратор 50 осуществляет мажерироединицы (в этом случае к выходам вание (выбор по большинству).

31.1.1-31,Я,З подключены выходы трех При этом на выходах 58 формируется контролируемых блоков.

25 информация, присутствующая на больКоммутация выходов контролируе- шинстве его соответствующих входах блоков происходит следующим об- 31. На выходах 57 шифРатоРа 50 поЯвразом. ляются сигналы при наличии расхождеI

Разрешенные кодовые комбинации мо- нии в информацииу поступающеи

ryT содержать либо все нули, либо три контролируемых логических блоков 6. единицы. Формирование сигналов 57 и 58 происПусть уровень логической единицы ходит по следующим законам присутствует на втором, пятом и седьмом адресных входах коммутатора 3, 57.j=((31. 1. 1)A(31. 1. 2)Л(3 1. 1.3)\/ тогда первый выход второго контроли- 35 A(31 1..1)A(31.1.2)A(31 1 3)jV руемого блока подключен к выходу Н Y((31. .1)A(31.i.2)A(31 .ТД)Н

31.1.1 коммутатора 3, второй выход Н (31. w . .1) Л (31. i . .2) A (31. i . .3)) Y этого же Вдове — ж выходУ 31.2.1 и Н... Н((31.Д.1)Л(31.Д.2)в(3).КЗ)Н

N-ый выход второго контролируе- Ч(31.N 1) g(31 ° N,2) A (31 N.З)з у мого блока подключен к выходу 31.Х.1.4О ) = 1,2,3; (7)

Аналогично выходы пятого контролируемого блока подключены к выходам 58. i=(31. i. 1 h 31. i, 2 h 31. i,3) V

31. 1.2-31.N.2 коммутатора 3, а выхо- V(31.i.1Л 31.i.2 Л31.i,3)U ды седьмого контролируемого блока — V(31.i.1h 31.i.2 А 31.i.З)Ч к выходам 3. 1. 3-31, N.3. V(31.i.1.А31.i,2 Л31.i.3), Синтез коммутатора 3 производится

1...N. на основании уравнений 1 — 3.

К примеру, если партия состоит из Перед началом процедуры контроля шести блоков (М=6), у каждого блока 5р все триггеры 53 обнулены и на М инпо одному выходу (!11=1), тогда формационных входов счетчика 52 присутствует уровень логического нуля.

31.1.1=(29.1. 1 A 30. 1)Ч(29.2.1Л30.2. h Счетчик 52 также обнулен, h 30.1) V(29.3,1 ЛЗО.Ç Л30.1 h С приходом первого синхроимпульса

А 30.2)Ч(29.4.1 А 30.4 А30.1 h 55 на вход 21 блока 4 на первых трех

Л30.2 h 30. 3); (4) разрядных вь)ходах счетчика 52 появляются уровни логической единицы, обеспечивающие организацию контроля первых трех логических блоков иэ партии

1305687

Если отдельные блоки бракованы, ное состояние фикси

t соответствующие триггеры 53 устанав- ванных блоков ливаются в единичное состояние, что у пРиводит к поЯвлению на соответствУю- 45 пул „а вход 21 бл щих установочных входах счетчика 52 лампочки нБр " В к уровней логической единицы Тем са- все триггеры 53 обну мым логические блоки, признанные бракованными, иэ дальнейшего контроля исключаются, т.е. на всех последующих 50 тестовых комбинациях на выходах счетчика 52, соответствующих бракованным блокам, уровень логической единицы формироваться не будет.

Так, если при контроле по первой тестовой комбинации второй и пятый логические блоки оказываются бракованными, то при контроле по второй тестовой комбинации счетчик 52 орга=

I I

2 5 7

5 первой тестовой комбинации. По второму синхроимпульсу на входе 21 логическая единица присутствует на четвертом, пятом и шестом разрядных выходах счетчика, обеспечивая тем самым контроль логических блоков 4 — 6 в партии по тестовой комбинации. Аналогично производится контроль всех M узлов. Коэффициент пересчета счетчика

52 равен M/3. Следует отметить, что число контролируемых блоков M не обязательно должно быть кратно трем. В этом случае коэффициент пересчета счетчика 52 округляется до ближайшего целого в большую сторону, а конт- .15 роль остающегося одного (в данном случае М-го) или двух ((И-1)-ro u Mго) блока производится соответственно с двумя или с одним наиболее близким к началу партии годным логичес- 2п ким блоком. Так, если M=31, а при контроле первой тестовой комбинации ни один из первых 31 логических блоков не оказывается бракованным, то при поступлении на вход 21 одиннад- 25 цатого синхроимпульса уровни логической единицы устанавливаются на M-м, первом и втором разрядных выходах счетчика 52. Уровень логической единицы на M-м выходе счетчика 52 ука- ЗО зывает, что все логические блоки в партии прошли контроль по текущей тестовой комбинации. При этом очередной импульс на входе 21 устанавливает счетчик 52 в нулевое состояние, а на его выходе заема появляется импульс, который "означает, что счетчик 52 готов к организации контроля блоков 6 по следующей тестовой комбинации. 40

6 низует разбиение блоков 6 на триоды следующим образом:(1,:3,4); (6,7,8) и т.д.

Контроль идет либо до полной проверки всех блоков по всем тестам, либо да того момента, когда остается не более двух годных логических блоков. В обоих случаях счетчик 52 устанавливается в нулевое состояние, и при каждом импульсе по входу 21 формируется импульс на выходе 17 блока

4 до тех пор, пока на него не поступит импульс с входа 19.

Дешифратор 5 1 представляет собой комбинационную схему. На однуиз групп входов поступают номера трех логических блоков, подвергающихся контролю в данный момент. Дешифратор 51 в зависимости от состояния на входах

57,1, 57,2, 57.3 и 56 признает все логические узлы годными либо указывает на брак одного или нескольких блоков.

Процедура функционирования дешифратора 51 в случае контроля второго, пятого и седьмого блоков в партии, что соответствует логической единице на втором, пятом и седьмом выходах счетчика 52, представлена в табл.1.

Единицы в графах состояния выходов дешифратора 51 означают брак соответствующих блоков. Состояние всех ос-тальных выходов (кроме второго, пятого и седьмого) дешифратора 51 в. данном случае иМеют уровень логического нуля. Работа дешифратора 51 при контроле любых трех логических блоков аналогична приведенной в таблице. При обнаружении дешифратора 51 бракованных блоков соответствующие триггеры 53 устанавливаются в.единичруя номера бракопо приходу имока 4 зажигает онце контроля ляются по вхоСостояние входов де- Состояние вы-шифратора 51 ходов дешифратора 51

0 0 0 0 0 0 0

0 0 1 0 0 0 1!

305687

Состояние входов д шифратора 5! остояние выодов дешифраора 51

1 ) )I

57.! 57.2 57.3

2 5 7

0 1

1 0

1 0

1 1

0 0

0 0

0 1

0 1

1, 0

1 0

Продолжение таблицы

0 1 0 0 0 1 0

1 0 0 1 1

0 0 1 0 0

1 0 1 0 1

0 0 1 1 0

1 0 1 1 1

0 1 1 0 0

1 1 1 0 1

0 1 1 1 0

1 1 1 1 1

0 1 0 0 0

1 1 0 0 1

0 1 0 1 0

1 1 1 0 1 1

В анализаторе сигнатур начальная установка производится сигналом высокого уровня на входе 22 и до прихода низкого уровня на вход 22, с каждым синхроимпульсом на входе 21, распределитель 59 формирует импульсы. На входы 58.1-58.N регистра 60 сдвига с элементами сложения по модулю два поступает информация с выходов блока

4 ° Регистр 60 с элементами сложения по модулю два имеет обратные связи, которые совместно с входами 58.1.—

58.N соединены с элементами сложения по модулю два. Этот код является сигнатурой, поступающей в регистр 61 для хранения. Перед началом формирования каждой очередной сигнатуры содержимое регистра 60 сдвига обнуляется.

Это устраняет влияние предшествующих сигнатур на последующие и препятствует накоплению ошибки при появлении

30 иепрагипьиой гигиатуры, При «r г впадении сигнатур формируется ксмаипа обмотки на и ходе 56.

Устройство работает следуюшим образом.

При пуске блок 1 формирует синхроимпульсы, поступающие на вход генератора 2, на выходе которого формируется необходимое количество комбинаций, устанавливающих контролируемые блоки в исходное состояние. 3атем на выходе генератора 2 появляется разрешающий уровень, и синхроимпульсы поступают в блоки 4 и 5. По каждому синхроимпульсу идет одновременно контроль трех блоков по перво— му тесту. Подключение выходов к входам шифратора осуществляет коммутатор в соответствии с номерами, задаваемыми счетчиком. При правильном функционировании индикация отсутствует.

Появление неправильной сигнатуры не прерывает процесс контроля, а помогает выявить брак. После прохождения контроля всех блоков по первому тесту счетчик формирует импульс, запрещающий прохождение синхроимпульсов на блок 4 и 5, и разрешает прохождение синхроимпульсов на вход генератора 2 и т.д.

Контроль будет проведен до конца, если количество годных блоков в партии не меньше трех. В противном случае контроль прерывается и горит либо (М-2) лампочки "Брак" (остается два годных блока), или (М вЂ” 1) лампочки (остается годный один блок), либо

М лампочек "Брак" (все остальные блоки признаны бракованными). При этом в первых двух случаях блоки, индикация номеров которых отсутствует (их может быть либо два, либо адин) проходят повторный контроль в составе следующей партии.

Выявление брака не прерывает процесс контроля.

Формула изобретения

Устройство для контроля логических блоков, содержащее блок управления, анализатор сигнатур, мажоритарный блок, генератор тестов, причем вход пуска устройства соединен с входом пуска блока управления, выход начала работы которого соединен с входом сброса анализатора сигнатур, группа информационных входов которого со1305687 единена с первой группой выходов мажоритарного блока, вход пуска которого соединен с выходом анализатора сигнатур, вход синхронизации которого соединен с выходом задания режима работы блока управления и с входом синхронизации мажоритарного блока, выходы генератора тестов являются информационными выходами устройства для подключения к информационным вхо- IO дам и контролируемых логических блоков, вход синхронизации генератора тестов соединен с выходом признака синхронизации блока управления, вход начала контроля которого соединен с 15 выходом признака начала контроля генератора тестов, выход признака конца контроля которого соединен с входом блокировки блока управления, при этом блок управления содержит генера- Я() тор синхроимпульсов, первый и второй триггеры, первый элемент ИЛИ и первый элемент И, а мажоритарный блок содержит дешифратор, причем выход генератора синхроимпульсов соединен с 25 первым входом первого элемента И, выход которого соединен с выходом задания режима работы блока управления, вход пуска которого соединен с входом установки первого триггера, выход ко- 30 торого соединен с входом пуска генератора синхроимпульсов, вход установки второго триггера соединен с входом начала контроля блока управления, выход признака конца контроля которого 35 соединен с выходом второго триггера, вход сброса которого соединен с входом блокировки блока управления, о тл и ч а ю щ е е с я тем, что, с целью повышения производительности конт-4р роля, устройство содержит коммутатор, мажоритарный блок содержит счетчик, шифратор, группу триггеров, а блок управления содержит третий триггер, элемент НЕ, второй элемент И и вто- 45 рой элемент ИЛИ, причем n/k групп информационных входов коммутатора являются и/k (k >. 3) группами информационных входов устройства для подключения к и/k групп выходов контролируемых логических блоков, выходы коммутатора соединены с информационными входами шифратора, группа разрядных выходов счетчика соединена с группой адресных входов коммутатора и с первой группой информационных входов дешифратора, выход признака конца контроля генератора тестов соединен с входом сброса счетчика и входами сброса триггеров группы, выход заема счетчика соединен с вторым входом первого элемента ИЛИ и с входом разрешения анализатора сигнатур,причем вход сброса первого триггера соединен с входом блокировки блока управления и с первым входом второго элемента ИЛИ, выход которого соединен с входом сброса третьего триггера, выход которого соединен с первым входом второго элемента И и через элемент НЕ с вторым входом первого элемента И, второй вход второго элемента И соединен с выходом генератора синхроимпульсов, выход второго элемента И соединен с выходом признака синхронизации блока управления, первый вход первого элемента ИЛИ соединен с входом пуска блока управления, выход первого элемента ИЛИ соединен с входом установки третьего, триггера, второй вход второго элемента ИЛИ соединен с входом начала контроля блока управления, вторая группа выходов шифратора соединена с второй группой информационных входов дешифратора, выходы которого соединены с входами установки соответствующих триггеров группы, выходы которых соединены с информационными входами счетчика, вход синхронизации счетчика соединен с синхровходом мажоритарного блока.

1305687

2 д

2 д

) 305 87

51.1 1

31. 1.3

Фиг, 5у

30)

30р

1305687

Составитель А. Сиротская

Редактор Г. Гербер Техред А.Кравчук Корректор Л. Пилипенко

Заказ 1453/47 Тираж 673 Подписное

ВНИИПИ Государственного комитета СССР по делам изобретений и открытий

113035, Москва, Ж-35, Раушская наб., д. 4/5

Производственно-полиграфическое предприятие, r. Ужгород, ул, Проектная, 4