Устройство для вычисления нелинейных интегральных операторов

Устройство для вычисления нелинейных интегральных операторов

Иллюстрации

Показать все

Реферат

 

Изобретение относится к цифровой вычислительной технике и применяется для решения интегральных уравнений Вольтерра-Гаммерштейна в задачах, ГП « /71fj связанных с расчетом прохождения сигналов в линиях связи, теплопереноса и т.д. Целью изобретения является повышение точности вычислений и быстродействия . Устройство содержит регистр 1 шага, первый блок элементов И 2, первьш накапливающий сумматор 3, первый блок сравнения 4, регистр 5 граничного значения, второй и третий блоки элементов И 6, 7, блок 8 вычисления ядра уравнения, четвертый блок элементов И 9, второй накапливающий сумматор 10, блок 11 вычисления подынтегральной функции, первый блок умножения 12, второй блок сравнения 13, второй блок умножения 14, элемент ИЛИ 15, элемент НЕ 16, первый коммутатор 17, пятый блок элементов И 18, элемент задержки 19, блок 20 сдвига, второй коммутатор 21, шестой блок элементов И 22, блок 23 элементов ИЛИ, третий накапливающий сумматор 24, 2 ил. «fci-Ш |Х (Л 4 1С 4

СОЮЗ СОВЕТСКИХ

СОЦИАЛИСТИЧЕСКИХ

РЕСПУБЛИК

„„SU„„1424017 А1 (51)4 G 06 F 7/64

f Þ

II

1 с"

ОПИСАНИЕ ИЗОБРЕТЕНИЯ

К ABTOPCHOMY СВИДЕТЕЛЬСТВУ

ГОСУДАРСТВЕННЫЙ КОМИТЕТ СССР

ПО ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТКРЫТИЙ (21) 4228299/24-24 (22) 16 ° 02.87 (46) 15.09.88. Бюл. К 34 (71) Ташкентский политехнический институт им. А. P. Бируни и Институт проблем моделирования в энергетике

АН УССР (72) А.Ф. Верлань, Б.Б. Абдусатаров, Ш.А. Акбаров, А.Ш. Шакамалов, Д„Д. Мансуров и М.M. Каримов (53) 681.32(088.8) (56) Авторское свидетельство СССР

У 840921, кл. G 06 F 7/64, 1980.

Авторское свидетельство СССР

В 188163, кл. С 06 F 7/64, 1973. (54) УСТРОЙСТВО ДЛЯ ВЫЧИСЛЕНИЯ НЕЛИНЕЙНЫХ ИНТЕГРАЛЬНЫХ ОПЕРАТОРОВ (57) Изобретение относится к цифровой вычислительной технике и применяется для решения интегральных уравнений

Вольтерра-Гаммерштейна в задачах, связанных с расчетом прохождения сигналов в линиях связи, теплопереноса и т.д. Целью изобретения является повышение точности вычислений и быстродействия. Устройство содержит регистр

1 шага, первый блок элементов И 2, первый накапливающий сумматор 3, первый блок сравнения 4, регистр 5 граничного значения, второй и третий блоки элементов И 6, 7, блок 8 вычисления ядра уравнения, четвертый блок элементов И 9, второй накапливающий сумматор 10, блок 11 вычисления подынтегральной функции, первый блок умножения 12, второй блок сравнения 13, второй блок умножения 14, элемент KIH

15, элемент НЕ 16, первый коммутатор

17, пятый блок элементов И 18, элемент е задержки 19, блок 20 сдвига, второй коммутатор 21, шестой блок элементов

И 22, блок 23 элементов ИЛИ, третий. накапливающий сумматор 24, 2 ил.

1424017

Изобретение относится к цифровой вычислительной технике и может найти применение в составе специализированного вычислительного устройства для

5 вычисления интегральных операторов

Вольтерра — Гаммерштейна с ядрами об щего вида для решения задач анализа и оптимизации нелинейных электрических цепей, измерения и контроля пара- 10 метров, моделирования, управления и регулирования объектов и процессов, связанных с преобразованием и передачей энергии, например преобразование энергии в различных датчиках, прохож- 15 дение сигналов в линиях связи, явления тепло- имассопереноса, химические: и ядерные превращения .и т.д.

Цель изобретения — повышение точности вычислений и быстродействия. ца фиг. 1 представлена структурная схема предлагаемого устройства; на фиг. 2 — временная диаграмма работы блоков устройства.

Устройство содержит регистр 1 25 шага, первый блок 2 элементов И, первьп1 накаплива)()п((ш сумматор 3, первый блок 4 сравнения, регистр 5 граничного значения, второй 6 и третий

7 блоки элементов И, блок 8 вычисле30 ния «дра уравнения, четвертый блок

9 элементов И, второй накапливающий су|п)атор 10> блок 11 вьг(ислення подынтегральной ())ункцпш, первый блок 12 умножения, второй блок 13 сравнения, второй блок 14 умножения, элемент 35

ИЛИ 15, элемент ПГп 16, первьп(коммутатор 17, пятый блок 18 элементов

И, элемент 19 задержки, блок 20 сдвига, второй коммутатор 21, шестой блок

22 элементов И, блок 23 элементов

ИЛИ, третий накачливаюп((ш сумматор

24, Описание физических процессов при решении задач (водится к решению пелинейного интегрального уравнения

Вольтерра-Гаммерштейна 2-ro рода

:.t

y(t) — J k(t,s)F(y(s))ds = f(t), (1)

tI где у(t) — исследуемьп(сигнал, 50

k(t, s) — ядро интегрального уравнения, которое несет информацию об исследуемом объекте,"

F — заданная нелинейная функция

f(t) — отклик объекта на исследуемый сигнал; время.

Эффективность реп)ения интегрального уравнения (1) зависит от того, насколько успешно будет реализован входящий в него интегральный оператор

W(t)= J k(t,s)F(lP (s)ds, (2)

От успешной реализации интегрального оператора зависит производительность и экономичность сепциализированных процессора и устройства, реализующих интегральный оператор и уравнение Вольтерра-Гаммерштейна.

В устройстве реализуется квадратурный метод численной реализации интегрального оператора (2) посредствОм расчетного выражения

P(t )=Q h Agk(t),t;)F ($(t1)j, (3) ,) о

05 npv j = 0, j = 1 где А„

1 при О c. j (i т.е. реализуются квадратурная формула трапеций с шагом дискретизации

h = const.

Устройство работает следующим образом.

Перед началом работы значение шага h заносится в первый регистр 1, а значение Ь верхней границы интегрального оператора — в регистр 5.Все остальные операционные блоки устанавливаются в "0". После подачи управляющего сигнала Пуск" на шину "Выдача кода" первого 3 и второго 10 накапливающих сумматоров (первый такт работы процессора) значение о — О с су)пчатора 3 поступает на первый вход первого блока 11 сравнения, на второй Hход которого с регистра 5 поступает значение Ь,(в результате этого в первом блоке 4 сравнения выполняется сравнение t с Ь. Одновременно значение переменной t = t = 0 поступает на первый вход второго блока 13 сравнения, на второй вход ко торого с накапливающего сумматора 10 поступает значение переменной

1 У вЂ” О, в результате чего на втором блоке 13 сравнения происходит сравнение переменной t = t с переменной

to . Кроме того, одновременно значение переменной t = 0 поступает

)) на и-входовый элемент ИЛИ 15 (на выходе которого в результате выполнения логической операции ИЛИ вырабатывается нулевой сигнал, выполняющий

1424017

20

30

40

50

55 функции управления) и на вход блока

11 (в нем вычисляется значение нелинейной функции F f P (t ) ) .

Во втором такте в первом умножителе 12 выполняется умножение значения шага h поступающего с регистра

1, на значение налинейной функции

F ((,) 1, поступающей с блока 11.

В результате получаем значение произведения h ° F (ф(г.,)j, а значения переменных tj = 0 и „ = 0 через открытые управляющим сигналом t 6 Ь с первого выхода первого блока 4 сравнения второй 6 и третий 7 блоки элементов И проходят на, блок 8, в результате чего в нем вычисляется значение ядра k(t, t,). Одновременно управляющий сигнал tj t;(j

i) поступает на вход элемента 19 задержки, на пину сброса третьего накапливающего сумматора, на первые входы первого 17 и второго 21 коммутаторов и открывает первый блок 2 элементов И, в результате чего на первом накапливающем сумматоре 3 вычисляется „ = С„ =, + h = h.

В третьем такте в первом блоке 4 сравнения выполняется сравнение

t „ = t с Ь, во втором блоке 13 сравнения — t с t.„ в блоке 11 вычисляется значение нелинейной функции

F Pg(t )j, а на втором умножителе 14 произведение h k(tp,, ) x Рfg (tp ))

В четвертом такте через открытый управляющим сигналом tJ C t с первого выхода второго блока сравнения четвертый блок 9 элементов И значение шага Ь поступает на второй накапливающий сумматор 10, где вычисляется значение t. = t t, + Ь = h в блоке

8 вычисляется значение ядра (,1, Q ), в первом умножителе 12 — произведение h FtÓ(t,)), в блоке 20 сдвига выполняется сдвиг на один разряд в в сторону мпадших разрядов значения произведения h. k(t„ t,) F(g(t )), в результате чего указанное значение произведения умножается на коэффициент А = 0,5.

В пятом такте в первом блоке 4 сравнения выполняется сравнение с Ь, во втором блоке 13 сравнения г. = tq с t< = t, в блоке 11 везтисляется значение Р(з (с,)1, во втором умножителе 14 - произведение

h "k(t<, e.,) F(f(t )), а в третьем накапливающем сумматоре 24 — значение функции f(ty) = 0,5 h k(tp, t ), F ф (to), через время задержки Т достаточное для фиксации и выдачи ре зультата, с элемента 19 задержки на шину сброса выходного накапливающего сумматора 24 поступает управляющий сигнал, который очищает и подготавливает его к вычислению следующего значения оператора f (t< ).

Таким образом, цикл работы устройства состоит из пяти тактов. Работа его иллюстрируется временной диаграммой (фиг. 2).

Как видно из временной диграммы, распараллеливание вычислительного процесса позволяет вычислять один член суммы

Ь А„1с(t tJ ) F($(tо))

i -=î за время t = 5 N ° at, где N — номер узла дискретизации, nt — квант времени, определяемый временем обработки информации в самом медленнодействующем операционном блоке устройства.

Однако после заполнения всех операционных блоков информацией время выдачи результата вычисления одного члена суммы за счет перекрытия циклов работы будет составлять Т,,д = 2 ° N° - zt т.е ° установившаяся производительность устройства будет всего лишь примерно в два раза меньше производительности

его самого медленнодействующего операционного блока. формула изобретения

Устройство для вычисления нелинейных интегральных операторов, содержащее элемент НЕ, регистр шага, регистр граничного значения и блок вычисления подынтегральной функции, о т л и ч аю щ е е с я тем, что, с целью повышения точности вычислений и быстродействия, оно содержит шесть блоков элементов И, блок вычисления ядра управления, блок элементов ИЛИ, три накапливающих сумматора, элемент задержки, два блока умножения, элемент ИЛИ, два блока сравнения, два коммутатора, блок сдвига, причем выходы регистра шага соединены с входами первого сомножителя первого блока умножения и первыми входами первого блока элементов И, выходы которого соединены с входами первого накапливающего сум-. матора, выходы которого соединены с входами первой группы первого и вто14240 рого блоков сравнения и первыми вхо дами второго блока элементов И; выходы регистра граничного значения соединены с входами второй группы первого блока сравнения, выход приз5 нака "Больше" которого соединен с вторыми входами второго и третьего блоков элементов, а выход признака

11 1I

Меньше — с выходо. окончания вычис-1О лений устройства, выходы регистра шага соединены с первыми входами четвертого блока элементов И, выходы которого соединены с информационными входами второго накапливающего сумматора, выходы которого соединены с входами аргумента блока вычисления подынтегральной функции, входами второй группы второго блока сравнения, входами второй группы элементов

ИЛИ и первыми входами третьего блока элементов И, выходы которого соединены с входами первого аргумента блока вычисления ядра управления, входы второго аргумента которого соединены . 25 с выходами второго блока элементовй, а выходы подключены к входам первого сомножителя второго блока умножения, выходы которого соединены с первыми входами пятого и шестого блоков 0 элементов И, выходы блока вычисления ядра уравнения соединены с входами второго сомножйтеля первого блока

17 умножения, выходы которого соединены с входами второго сомножителя второго блока умножения, первый выход второго блока сравнения соединен с первыми информационными входами первого и второго коммутаторов и вторым вхо дом четвертого блока элементов И, выход признака "Меньше" блока сравнения соединен с входом сброса второго накапливающего сумматора, вторым входом первого блока элементов И, вторыми информационными входами первого и второго коммутаторов и входом элемента НЕ, выход которого соединен с входом сброса третьего накапливающего сумматора, выходы которого подключены к информационным входам устройства, выход элемента ИЛИ соединен с первыми управляющими входами первого и второго коммутаторов и входом элемента НЕ, выход которого подключен к вторым управляющим входам первого и второго коммутаторов, выход первого коммутатора соединен с вторым входом пятого блока элементов И, выходы которого через блок сдвига соединен с входами первой группы блока элементов ИЛИ, выходы которого соединены с информационными входами третьего накапливающего сумматора, выход второго коммутатора соединен с вторым входом шестого блока элементов И.

ВНИИПИ Заказ 4688/51 Ти аж 704 Подписное

Произв.-полигр. пр-тие, г. Ужгород, ул. Проектная, 4