Трехчастотный модулятор

Трехчастотный модулятор

Реферат

 

Изобретение относится к технике радиосвязи и может применяться в системах подвижной наземной и спутниковой связи. Технический результат заключается в уменьшении реальной ширины спектра модулированного сигнала при сохранении индекса частотной манипуляции m=0,5. Устройство содержит анализатор состояния фазовращающих напряжений 1, блок формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов 2, логический блок формирования управляющих напряжений для блока ключей 3, блок ключей 4, преобразователь кода 5, два амплитудно-фазовых модулятора 6, 7, фазовращатель 8, генератор несущей 9, сумматор 10. В изобретении решается задача использования трех частот манипуляции для создания частотно-манипулированного сигнала без разрыва фазы. 18 ил., 3 табл.

Изобретение относится к области радиосвязи и может быть использовано в цифровых системах, в частности в системах спутниковой и наземной подвижной радиосвязи для создания колебаний с угловой модуляцией с компактным спектром.

Аналогами заявляемого устройства являются частотные модуляторы, использующие квадратурные схемы формирования модулированного сигнала, к которым относятся, например, модуляторы /4-DQPSK и CQPSK (Овчинников М.А., Воробьев С.П., Сергеев С.И. Открытые стандарты цифровой транкинговой радиосвязи. Серия изданий “Связь и бизнес”. М.: МЦНТИ, ООО “Мобильные коммуникации”, 2000, 166 с. См. с.73 и 158). Эти модуляторы выполнены по одинаковым структурным схемам (рис. 9.1 и 8.10). Различаются они только фильтрами и скоростью передачи информации (с.160). Эти модуляторы включат в себя устройство перекодировки, два фильтра нижних частот (фильтры Найквиста), два амплитудных модулятора и сумматор, причем два выхода устройства перекодировки соединяются соответственно с входами фильтров нижних частот, выходы ФНЧ соединяются с входами амплитудных модуляторов, выходы этих модуляторов соединяются с входами сумматора, выход которого является выходом частотного модулятора. Недостатком этих частотных модуляторов является наличие сопутствующей амплитудной модуляции выходного сигнала. При таком сигнале усилитель мощности передатчика должен работать в линейном режиме, что исключает возможность использования высокоэффективных режимов работы передатчика с высоким кпд (с.80). Причина появления сопутствующей AM заключается в используемом методе формирования модулирующих напряжений для модуляторов в квадратурных каналах (использование реакции фильтров Найквиста при действии на их входах коротких импульсов возбуждения).

Наиболее близким по технической сущности является модулятор, осуществляющий частотную модуляцию без разрыва фазы Minimum Shift Keying (MSK) или, что то же самое, модуляцию минимальным частотным сдвигом (ММС) (см. книгу: Банкет В Л., Дорофеев В.М. Цифровые методы в спутниковой связи. - М.: Радио и связь. 1988. - 240 с., ил., с. 39-40, рис. 2.1б, 2.2).

Этот модулятор содержит переключатель посылок на два канала (четные - в один канал, нечетные - в другой), генератор сглаживающих напряжений, два перемножителя, генератор несущей, фазовращатель, два амплитудно-фазовых модулятора и сумматор. Поочередное переключение посылок входного модулирующего сигнала на два канала обеспечивает увеличение в два раза длительности посылок в каждом канале. Сглаживание прямоугольных посылок длительностью 2Т₀ по законам

в каждом канале, соответственно, обеспечивает форму огибающих ВЧ-напряжений на выходах амплитудно-фазовых модуляторов в соответствии с напряжениями u₁ и u₂, вследствие чего осуществляется плавное изменение фазы ВЧ-колебаний на выходе сумматора за время Т₀ на + /2 или - /2 в зависимости от посылки входного модулирующего сигнала (0 или 1). Такое изменение фазы соответствует индексу частотной модуляции выходного сигнала m=0,5. Выбранная форма напряжений u₁ и u₂ на входах квадратурных амплитудно-фазовых модуляторов обеспечивает отсутствие сопутствующей AM выходного сигнала, т.е. в данном модуляторе отсутствует основной недостаток модуляторов CQPSK и /4-DQPSK. Кроме того, данный модулятор, благодаря линейному изменению фазы за время посылки, отсутствию скачков фазы на границах посылок, формирует на выходе модулированное по частоте напряжение с компактным спектром. Реальная ширина спектра модулированного таким образом сигнала составляет 1,18 V, где V - скорость передачи, бит/с. Применение в модуляторе ММС фильтра Гаусса дает дополнительные возможности уменьшения занимаемой полосы частот (модуляция GMSK, см., например, книгу: Ратынский М.В. Основы сотовой связи/ Под ред. Д.Б.Зимина. - М.: Радио и связь, 1998. - 248 с., ил., с.121-126). Кроме того, в данном модуляторе нет прямого воздействия на генератор несущей, благодаря чему обеспечивается высокая стабильность несущего колебания и возможность оперативной смены несущей частоты, что важно для систем со скачкообразным изменением частоты.

Вместе с тем, требования к уменьшению реальной ширины спектра постоянно растут, а возможности модулятора ММС не соответствуют этим требованиям. Таким образом, сравнительно широкая реальная ширина спектра формируемого сигнала является недостатком модулятора ММС. Причиной этого является использование в модуляторе двухчастотной модуляции, и соответственно, двоичного цифрового сигнала, обладающего информационной избыточностью, которая не используется для уменьшения реальной ширины спектра.

Заявляемое изобретение направлено на решение задачи использования трех частот манипуляции для создания частотно-манипулированного сигнала без разрыва фазы. Это позволяет использовать информационную избыточность двоичного цифрового сигнала. а также уменьшение необходимой девиации частоты и перераспределение энергии в спектре сигнала для получения основного технического результата - уменьшения реальной ширины спектра при сохранении индекса частотной модуляции m=0,5.

Решение этой задачи достигается тем, что в частотный модулятор, содержащий генератор несущей, фазовращатель, два амплитудно-фазовых модулятора и сумматор, причем выход генератора несущей соединяется с первым входом первого амплитудно-фазового модулятора и с входом фазовращателя, выход фазовращателя соединяется с первым входом второго амплитудно-фазового модулятора, выходы амплитудно-фазовых модуляторов соединяются, соответственно, с первым и вторым входами сумматора, выход которого является выходом трехчастотного модулятора, дополнительно включаются анализатор состояния фазовращающих напряжений, блок формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, логический блок формирования управляющих напряжений для блока ключей, блок ключей и преобразователь кода, причем один вход преобразователя кода является входом трехчастотного модулятора, три других входа соединяются с тремя соответствующими выходами блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, три выхода преобразователя кода соединяются с тремя соответствующими входами логического блока формирования управляющих напряжений для блока ключей, восемь других входов логического блока формирования управляющих напряжений для блока ключей соединяются с восемью соответствующими выходами анализатора состояний фазовращающих напряжений, восемь выходов логического блока формирования управляющих напряжений для блока ключей соединяются с восемью управляющими входами блока ключей, четыре сигнальных входа блока ключей соединяются с четырьмя соответствующими выходами блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, первый выход блока ключей соединяется с вторым входом первого амплитудно-фазового модулятора и с первым входом анализатора состояний фазовращающих напряжений, второй выход блока ключей соединяется с вторым входом второго амплитудно-фазового модулятора и с вторым входом анализатора состояния фазовращающих напряжений, а два выхода блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, соединенные с входами преобразователя кода, соединяются с третьим и четвертым входами анализатора состояния фазовращающих напряжений.

Анализатор состояния фазовращающих напряжений включает в себя два инвертора, 8 элементов И, один элемент НЕТ, три элемента ИЛИ и 8 расширителей импульсов, причем вход первого инвертора соединяется с первыми входами первого и второго элементов И и является первым входом анализатора состояния фазовращающих напряжений, вход второго инвертора соединяется с первыми входами пятого и шестого элементов И и является вторым входом анализатора состояния фазовращающих напряжении, выход первого инвертора соединяется с первыми входами 3-го и 4-го элементов И, выход второго инвертора соединяется с первыми входами 7-го и 8-го элементов И, первый вход первого элемента ИЛИ соединяется с вторыми входами 1-, 3-, 5- и 7-го элементов И и является третьим входом анализатора состояния фазовращающих напряжений, второй вход первого элемента ИЛИ соединяется с вторыми входами 2-, 4-, 6- и 8-го элементов И и является четвертым входом анализатора состояния фазовращающих напряжений, выход каждого из элементов И соединяется с соответствующим входом второго элемента ИЛИ и, кроме того, выход первого элемента И соединяется с вторым входом третьего элемента ИЛИ, выходы элементов И с второго по восьмой соединяются с первыми входами расширителей импульсов, соответственно, с второго по восьмой, выход первого элемента ИЛИ соединяется с первым входом элемента НЕТ и с вторыми входами всех расширителей импульсов, выход второго элемента ИЛИ соединяется с вторым входом элемента НЕТ, выход элемента НЕТ соединяется с первым входом третьего элемента ИЛИ, выход которого соединяется с первым входом первого расширителя импульсов, а выходы расширителей импульсов являются выходами анализатора состояния фазовращающих напряжений.

Блок формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов содержит задающий генератор, делители частоты на два, на 4 и на 6, блок предустановки триггеров делителей частоты, четыре дифференцирующие цепи с ограничением по минимуму, два формирователя напряжения пилообразной формы, два формирователя напряжения синусоидальной формы и один элемент ИЛИ, причем выход задающего генератора соединяется с первым входом делителя частоты на два, выход делителя частоты на два соединяется с первыми входами делителей частоты на 4 и на 6, второй вход делителя частоты на два соединяется с первым выходом блока предустановки триггеров делителей частоты, вторые входы делителей частоты на 4 и на 6 соединяются с вторым выходом блока предустановки триггеров делителей частоты, первый выход делителя частоты на 6 соединяется с входом второго формирователя напряжения пилообразной формы и с входом первой дифференцирующей цепи с ограничением по минимуму, выход которой является выходом блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, второй выход делителя частоты на 6 соединяется с входом первого формирователя напряжения пилообразной формы и входом второй дифференцирующей цепи с ограничением по минимуму, выход которой является выходом блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, первый выход делителя частоты на 4 соединяется с входом третьей дифференцирующей цепи с ограничением по минимуму, второй выход делителя частоты на 4 соединяется с входом четвертой дифференцирующей цепи с ограничением по минимуму, выход первого формирователя напряжения пилообразной формы соединяется с входом первого формирователя напряжения синусоидальной формы, два выхода которого являются выходами блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, выход второго формирователя напряжения пилообразной формы соединяется с входом второго формирователя напряжения синусоидальной формы, два выхода которого являются выходами блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, выход третьей дифференцирующей цепи соединяется с первым входом элемента ИЛИ, выход четвертой дифференцирующей цепи соединяется со вторым входом элемента ИЛИ, а выход элемента ИЛИ является выходом блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов.

Логический блок формирования управляющих напряжений для блока ключей выполнен на 24-х элементах И и 14-ти элементах ИЛИ, причем первые входы элементов И с первого по восьмой соединяются между собой и являются первым входом логического блока формирования управляющих напряжений для блока ключей, первые входы элементов И с 9-го по 16-й соединяются между собой и являются вторым входом логического блока формирования управляющих напряжений для блока ключей, первые входы элементов И с 17-го по 24-й соединяются между собой и являются третьим входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 1-, 9- и 17-го элементов И соединяются между собой и являются четвертым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 2-, 10- и 18-го элементов И соединяются между собой и являются пятым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 3-, 11- и 19-го элементов И соединяются между собой и являются шестым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 4-, 12- и 20-го элементов И соединяются между собой и являются седьмым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 5-, 13- и 21-го элементов И соединяются между собой и являются восьмым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 6-, 14- и 22-го элементов И соединяются между собой и являются девятым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 7-, 15- и 23-го элементов И соединяются между собой и являются десятым входом логического блока формирования управляющих напряжений для блока ключей, вторые входы 8-, 16- и 24-го элементов И соединяются между собой и являются одиннадцатым входом логического блока формирования управляющих напряжений для блока ключей, выход первого элемента И соединяется с входами 1-го и 8-го элементов ИЛИ, выход второго элемента И соединяется с входами 2-го и 9-го элементов ИЛИ, выход третьего элемента И соединяется с входами 3-го и 10-го элементов ИЛИ, выход четвертого элемента И соединяется с входами 4-го и 11-го элементов ИЛИ, выход пятою элемент 11 соединяется с входами 4-го и 9-го элементов ИЛИ, выход шестого элемента И соединяется с входами 3-го и 8-го элементов ИЛИ, выход седьмого элемента И соединяется с входами 2-го и 11-го элементов ИЛИ, выход восьмого элемента И соединяется с входами 1-го и 10-го элементов ИЛИ, выход девятого элемента И соединяется с входами 5-го и 14-го элементов ИЛИ, выход десятого элемента И соединяется с входами 5-го и 14-го элементов ИЛИ, выход одиннадцатого элемента И соединяется с входами 6-го и 14-го элементов ИЛИ, выход двенадцатого элемента И соединяется с входами 6-го и 14-го элементов ИЛИ, выход тринадцатого элемента И соединяется с входами 7-го и 13-го элементов ИЛИ, выход четырнадцатого элемента И соединяется с входами 7-го и 13-го элементов ИЛИ, выход пятнадцатого элемента И соединяется с входами 7-го и 12-го элементов ИЛИ, выход шестнадцатого элемента И соединяется с входами 7-го и 12-го элементов ИЛИ, выход семнадцатого элемента И соединяется с входами 1-го и 10-го элементов ИЛИ, выход восемнадцатого элемента И соединяется с входами 2-го и 11-го элементов ИЛИ, выход девятнадцатого элемента И соединяется с входами 3-го и 8-го элементов ИЛИ, выход двадцатого элемента И соединяется с входами 4-го и 9-го элементов ИЛИ, выход двадцать первого элемента И соединяется с входами 2-го и 9-го элементов ИЛИ, выход двадцать второго элемента И соединяется с входами 1-го и 8-го элементов ИЛИ, выход двадцать третьего элемента И соединяется с входами 4-го и 11-го элементов ИЛИ, выход двадцать четвертого элемента И соединяется с входами 3-го и 10-го элементов ИЛИ, а выходы всех элементов ИЛИ являются выходами логического блока формирования управляющих напряжений для блока ключей.

Блок ключей состоит из 14 аналоговых ключей, причем первые входы попарно 1- и 8-го, 2- и 9-го, 3- и 10-го, 4- и 11-го, 5- и 12-го, 6- и 13-го, 7- и 14-го аналоговых ключей соединены между собой и являются входами блока ключей, вторые входы всех ключей также являются входами блока ключей, выходы аналоговых ключей с 1-го по 7-й соединяются между собой и являются первым выходом блока ключей, выходы аналоговых ключей с 8-го по 14-й также соединяются между собой и являются вторым выходом блока ключей.

Преобразователь кода содержит регистр сдвига, 3 элемента НЕ, 8 элементов И, 10 элементов ИЛИ, 7 расширителей импульсов и три элемента НЕТ, причем первый вход регистра сдвига является первым входом преобразователя кода, второй вход регистра сдвига соединяется с первым входом первого расширителя импульсов и является вторым входом преобразователя кодов, второй вход первого расширителя импульсов соединяется с вторыми входами 5-, 6- и 7-го расширителей импульсов и является третьим входом преобразователя кода, выход первого расширителя импульсов соединяется с третьим входом регистра сдвига и с четвертыми входами элементов И, первый выход регистра сдвига соединяется с входом первого элемента НЕ и с входами 5-, 6-, 7- и 8-го элементов И, второй выход регистра сдвига соединяется с входом второго элемента НЕ и с входами 3-, 4-, 7- и 8-го элементов И, третий выход регистра сдвига соединяется с входом третьего элемента НЕ и с входами 2-, 4-, 6- и 8-го элементов И, выход первого элемента НЕ соединяется с входами 1-, 2-, 3- и 4-го элементов И, выход второго элемента НЕ соединяется с входами 1-, 2-, 5- и 6-го элементов И, выход третьего элемента НЕ соединяется с входами 1-, 3-, 5- и 7-го элементов И, выход первого элемента И соединяется с входами 3- и 6-го элементов ИЛИ, выход второго элемента И соединяется с входами 3- и 5-го элементов ИЛИ, выход третьего элемента И соединяется с входами 3- и 4-го элементов ИЛИ, выход четвертого элемента И соединяется с входами 2- и 6-го элементов ИЛИ, выход пятого элемента И соединяется с входами 2- и 5-го элементов ИЛИ, выход шестого элемента И соединяется с входами 2- и 4-го элементов ИЛИ, выход седьмого элемента И соединяется с входами 1- и 5-го элементов ИЛИ, выход восьмого элемента И соединяется с входами 1- и 4-го элементов ИЛИ, выходы элементов ИЛИ с 1- по 6-й соединяются с первыми входами расширителей импульсов, соответственно, с второго по седьмой, вторые входы второго третьего и четвертого расширителей импульсов соединяются между собой и являются четвертым входом преобразователя кода, выход второго расширителя импульсов соединяется с входами 7- и 8-го элементов ИЛИ, выход третьего расширителя импульсов соединяется с входами 7- и 9-го элементов ИЛИ, выход четвертого расширителя импульсов соединяется с входами 7- и 10-го элементов ИЛИ, выход пятою расширителя импульсов соединяется с первым входом первого элемента НЕТ, выход шестого расширителя импульсов соединяется с первым входом второго элемента НЕТ, выход седьмого расширителя импульсов соединяется с первым входом третьего элемента НЕТ, выход 7-го элемента ИЛИ соединяется с вторыми входами элементов НЕТ, выходы первого, второго и третьего элементов НЕТ соединяются с входами, соответственно, восьмого, девятого и десятого элементов ИЛИ, выходы которых являются выходами преобразователя кода.

Совокупность признаков, характеризующих в целом трехчастотный модулятор, обеспечивает получение технического результата во всех случаях, на которые испрашивается объем правовой защиты, а признаки, относящиеся к анализатору состояния фазовращающих напряжений, блоку формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, логическому блоку формирования управляющих напряжений для блока ключей, блоку ключей и преобразователю кода, характеризуют его лишь в конкретной форме выполнения.

Все существенные признаки заявляемого изобретения находятся в причинно-следственной связи с достигаемым техническим результатом. Преобразователь кода из входного модулирующего двоичного сигнала, имеющего длительность элементов Т₀, формирует троичный сигнал в позиционном коде, имеющий длительность посылок 3Т₀/2. Для осуществления модуляции несущей этим троичным сигналом используется трехчастотная модуляция без разрыва фазы. Частота посылок ВЧ-сигнала изменяется с помощью элементов, используемых в устройстве-прототипе: амплитудно-фазовых модуляторов, генератора несущей, фазовращателя и сумматора. Однако для того, чтобы модуляция была трехчастотной, на входы фазовых модуляторов необходимо подавать модулирующие (фазовращающие) напряжения специальной формы. Эти напряжения формируются функциональными узлами, которых нет в прототипе: анализатором состояния фазовращающих напряжений, блоком формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, логическим блоком формирований управляющих напряжений для блока ключей и блоком ключей. Анализатор состояния фазовращающих напряжений определяет состояние фазовращающих напряжений на входах амплитудно-фазовых модуляторов в каждый тактовый момент времени, логический блок формирования управляющих напряжений для блока ключей на основе результатов этого анализа и выходных сигналов преобразователя кода определяет форму фазовращающих напряжений, которые должны поступать на каждый амплитудно-фазовый модулятор в течение последующего тактового интервала, чтобы посылка выходного напряжения имела соответствующую частоту, и открывает необходимую пару ключей в блоке ключей (по одному для каждого амплитудно-фазового модулятора). Через открытые ключи необходимые фазовращающие напряжения с выходов блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов поступают на амплитудно-фазовые модуляторы. При этом на выходе частотного модулятора формируется трехчастотный модулированный сигнал без разрыва фазы с индексом модуляции 0,5. Длительность посылок этого сигнала в 1,5 раза больше длительности посылок двоичного цифрового сигнала, поступающего на вход модулятора и, соответственно, в 1,5 раза больше длительности посылок сигнала ММС. Увеличение длительности посылок приводит к уменьшению реальной ширины спектра сигнала, что и определяет технический результат заявляемого изобретения. Кроме того, в сформированном 3-частотном сигнале девиация частоты в 1,5 раза меньше, чем в сигнале ММС, а третья частота манипуляции расположена на частоте несущей, т.е. посередине между двумя первыми частотами, и эти два фактора также уменьшают ширину спектра сигнала.

На фиг.1 представлена структурная схема частотного модулятора, на фиг.2 - структурная схема анализатора состояния фазовращающих напряжений, на фиг.3 структурная схема блока формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, на фиг.4 - структурная схема логического блока формирования управляющих напряжений для блока ключей, на фиг.5 - структурная схема блока ключей, на фиг.6 - структурная схема преобразователя кода, на фиг.7 - схема элемента 8 ИЛИ, на фиг.8 - схема элемента НЕТ, на фиг.9 - схема расширителя импульсов, на фиг.10 - схема задающего генератора, на фиг.11 - схема блока предустановки триггеров делителей частоты, на фиг.12 - схема делителя частоты на шесть, на фиг.13 - схема формирователей напряжения прямоугольной формы и формирователя напряжения синусоидальной формы, на фиг.14 - схема дифференцирующей цепи с ограничением по минимуму, на фиг.15 - схема элемента 4 ИЛИ, на фиг.16 - временные диаграммы сигналов в блоке формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, на фиг.17 - временные диаграммы сигналов в преобразователе кода, на фиг.18 - временные диаграммы, поясняющие принцип работы трехчастотного модулятора.

Трехчастотный модулятор содержит анализатор 1 состояния фазовращающих напряжений, блок 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, логический блок 3 формирования управляющих напряжений для блока ключей, блок 4 ключей, преобразователь 5 кода, первый амплитудно-фазовый модулятор 6, второй амплитудно-фазовый модулятор 7, фазовращатель 8, генератор 9 несущей и сумматор 10. Анализатор 1 состояния фазовращающих напряжений содержит инверторы 11 и 12, элементы 14-21 И, элементы 13, 22, 23 ИЛИ, элемент 24 НЕТ и расширители 25-32 импульсов. Блок 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов содержит задающий генератор 33, делитель 34 частоты на два, делитель 35 частоты на 6, делитель 36 частоты на 4, блок 37 предустановки, формирователи 38 и 39 напряжения пилообразной формы, формирователи 40 и 41 напряжения синусоидальной формы, дифференцирующие цепи 42-45 с ограничением по минимуму и элемент 46 ИЛИ. Логический блок формирования управляющих напряжений для блока ключей содержит элементы 47-70 И и элементы 71-84 ИЛИ. Блок ключей содержит аналоговые ключи 85-98. Преобразователь 5 кода содержит регистр 99 сдвига, элементы 100-102 НЕ, элементы 104-111 И, элементы 112-117, 124-127 ИЛИ, расширители 118-123 импульсов и элементы 128-130 НЕТ.

Первый вход преобразователя 5 кода (на фиг.6 это первый вход регистра 99 сдвига) является входом трехчастотного модулятора, на который подается входной двоичный модулирующий сигнал. Второй вход преобразователя 5 кода соединяется с выходом элемента 46 ИЛИ блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов (тактовые импульсы ТИ0, см. фиг.16). Третий вход преобразователя кода, соединенный с входом расширителя 103 импульсов, соединяется с выходом дифференцирующей цепи 42 (импульсы ТИ1, фиг.16). Четвертый вход преобразователя 5 кода соединяется с выходом дифференцирующей цепи 43 блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов (импульсы ТИ2, фиг.16). Три выхода преобразователя 5 кода соединяются с тремя входами логического блока 3 формирования управляющих напряжений для блока ключей, при этом выход элемента 125 ИЛИ соединяется с первыми входами элементов 47-54 И, выход элемента 126 ИЛИ соединяется с первыми входами элементов 55-62 И и выход элемента 127 ИЛИ соединяется с первыми входами элементов 63-70 И. 14 выходов логического блока 3 формирования управляющих напряжений для блока ключей соединяются с 14-ю входами блока ключей, при этом выход элемента 71 ИЛИ соединяется с управляющим входом ключа 85, выход элемента 72 ИЛИ соединяется с управляющим входом ключа 86, выход элемента 73 ИЛИ соединяется с управляющим входом ключа 87, выход элемента 74 ИЛИ соединяется с управляющим входом ключа 88, выход элемента 75 ИЛИ соединяется с управляющим входом ключа 89, выход элемента 76 ИЛИ соединяется с управляющим входом ключа 90, выход элемента 77 ИЛИ соединяется с управляющим входом ключа 91, выход элемента 78 ИЛИ соединяется с управляющим входом ключа 93, выход элемента 79 ИЛИ соединяется с управляющим входом ключа 92, выход элемента 80 ИЛИ соединяется с управляющим входом ключа 95, выход элемента 81 ИЛИ соединяется с управляющим входом ключа 94, выход элемента 82 ИЛИ соединяется с управляющим входом ключа 97, выход элемента 83 ИЛИ соединяется с управляющим входом ключа 96, выход элемента 84 ИЛИ соединяется с управляющим входом ключа 98. Восемь выходов анализатора 1 состояния фазовращающих напряжений соединяются с восемью входами логического блока 3 формирования управляющих напряжений для блока ключей, при этом выход расширителя 25 импульсов соединяется с вторыми входами элементов 47, 55, 63 И, выход расширителя 26 импульсов соединяется с вторыми входами элементов 48, 56 и 64 И, выход расширителя 27 импульсов соединяется с вторыми входами элементов 49, 57 и 65 И, выход расширителя 28 импульсов соединяется с вторыми входами элементов 50, 58, 66 И, выход расширителя 29 импульсов соединяется с вторыми входами элементов 51, 59 и 67 И, выход расширителя 30 импульсов соединяется с вторыми входами элементов 52, 60 и 68 И, выход расширителя 31 импульсов соединяется с вторыми входами элементов 53, 61 и 69 И, выход расширителя 32 импульсов соединяется с вторыми входами элементов 54, 62 и 70 И. Четыре выхода блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов соединяются с четырьмя входами блока 4 ключей, при этом первый выход формирователя 40 напряжения синусоидальной формы соединяется с сигнальными входами ключей 85 и 92, первый выход формирователя 41 напряжения синусоидальной формы соединяется с сигнальными входами ключей 86 и 93, второй выход формирователя 40 напряжения синусоидальной формы соединяется с сигнальными входами ключей 87 и 94, второй выход формирователя 41 напряжения синусоидальной формы соединяется с сигнальными входами ключей 88 и 95. На сигнальные входы ключей 89 и 96 подается постоянное напряжение уровнем +а, на сигнальные входы ключей 90 и 97 подается постоянное напряжение -а, на сигнальные входы ключей 91 и 98 подается нулевое напряжение. Первый выход блока 4 ключей соединяется с первым входом анализатора 1 состояния фазовращающих напряжений, при этом точка соединения ключей 85-91 соединяется со входами инвертора 11 и элементов 14 и 15 И, и эта точка соединяется с вторым входом амплитудно-фазового модулятора 6. Второй выход блока 4 ключей соединяется с вторым входом анализатора 1 состояния фазовращающих напряжений, при этом точка соединения ключей 92-98 соединяется с входами инвертора 12 и элементов 18 и 19 И, и эта точка соединяется с вторым входом амплитудно-фазового модулятора 7. Два выхода блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов соединяются с двумя соответствующими входами анализатора 1 состояния фазовращающих напряжений, при этом выходы дифференцирующих цепей 42 и 43 соединяются, соответственно, с входами элемента 22 ИЛИ.

В анализаторе 1 состояния фазовращающих напряжений вход инвертора 11 соединяется с первыми входами элементов 14 и 15 И, вход инвертора 12 соединяется с первыми входами элементов 18 и 19 И, выход инвертора 11 соединяется с первыми входами элементов 16 и 17 И, выход инвертора 12 соединяется с первыми входами элементов 20 и 21 И, первый вход элемента 22 ИЛИ соединяется с вторыми входами элементов 14, 16, 18 и 20 И, второй вход элемента 22 ИЛИ соединяется с вторыми входами элементов 15, 17, 19 и 21 И, выход каждого из элементов И соединяется с соответствующим входом элемента 13 ИЛИ и, кроме того, выход элемента 14 И соединяется с вторым входом элемента 23 ИЛИ, выходы элементов 15-21 И соединяются с первыми входами расширителей 26-32 импульсов, выход элемента 22 ИЛИ соединяется с первым входом элемента 24 НЕТ и с вторыми входами всех расширителей импульсов, выход элемента 13 ИЛИ соединяется с вторым входом элемента 24 НЕТ, выход элемента 24 НЕТ соединяется с первым входом элемента 23 ИЛИ, выход которого соединяется с первым входом расширителя 25 импульсов, а выходы расширителей импульсов являются выходами анализатора 1 состояния фазовращаюших напряжений.

В блоке 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов выход задающего генератора 33 (см. фиг.3) соединяется с первым входом делителя 34 частоты на два, выход делителя 34 частоты на два соединяется с первыми входами делителя 35 частоты на 6 и делителя 36 частоты на 4, второй вход делителя частоты на два соединяется с первым выходом блока 37 предустановки, вторые входы делителей 35 и 36 частоты на 4 и на 6 соединяются с вторым выходом блока 37 предустановки триггеров делителей частоты, первый выход делителя 35 частоты на 6 соединяется с входом формирователя 39 напряжения пилообразной формы и с входом дифференцирующей цепи 42 с ограничением по минимуму, выход которой является выходом блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, второй выход делителя 35 частоты на 6 соединяется с входом формирователя 38 напряжения пилообразной формы и с входом дифференцирующей цепи 43 с ограничением по минимуму, выход которой является выходом блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, первый выход делителя 36 частоты на 4 соединяется с входом дифференцирующей цепи 44 с ограничением по минимуму, второй выход делителя 36 частоты на 4 соединяется с входом дифференцирующей цепи 45 с ограничением по минимуму, выход формирователя 38 напряжения пилообразной формы соединяется с входом формирователя 40 напряжения синусоидальной формы, два выхода которого являются выходами блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, выход формирователя 39 напряжения пилообразной формы соединяется с входом формирователя 41 напряжения синусоидальной формы, два выхода которого являются выходами блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов, выход дифференцирующей цепи 44 соединяется с первым входом элемента 46 ИЛИ, выход дифференцирующей цепи 45 соединяется с вторым входом элемента 46 ИЛИ, а выход элемента 46 ИЛИ является выходом блока 2 формирования последовательностей сигналов заданной формы и последовательностей тактовых импульсов.

В логическом блоке 3 формирования управляющих напряжений для блока ключей первые входы элементов 47-54 И соединяются между собой и являются первым входом логического блока 3 формирования управляющих напряжений для блока ключей, первые входы элементов 55-62 И соединяются между собой и являются вторым входом логического блока 3 формирования управляющих напряжений для блока ключей, первые входы элементов 63-70 И соединяются между собой и являются третьим входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 47, 55 и 63 И соединяются между собой и являются четвертым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 48, 56 и 64 И соединяются между собой и являются пятым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 49, 57 и 65 И соединяются между собой и являются шестым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 50, 58 и 66 И соединяются между собой и являются седьмым входом логического блока 3 формирования управляющих напряжений для блока ключей.

Вторые входы элементов 51, 59 и 67 И соединяются между собой и являются восьмым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 52, 60 и 68 И соединяются между собой и являются девятым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 53, 61 и 69 И соединяются между собой и являются десятым входом логического блока 3 формирования управляющих напряжений для блока ключей, вторые входы элементов 54, 62 и 70 И соединяются между собой и являются одиннадцатым входом логического блока 3 формирования управляющих напряжений для блока ключей, выход элемента 47 И соединяется с входами элементов 71 и 78 ИЛИ, выход элемента 48 И соединяется с входами элементов 72 и 78 ИЛИ, выход элемента 49 И соединяется с входами элементов 73 и 80 ИЛИ, выход элемента 50 И соединяется с входами элементов 74 и 81 ИЛИ, выход элемента 51 И соединяется с входами элемен