Запоминающее устройство со считыванием без разрушения информации

Запоминающее устройство со считыванием без разрушения информации

Иллюстрации

Показать все

Реферат

 

Союз Советскик

Социвлистическик

Республик

К АВТОРСКОМУ СВИДЕТЕЛЬСТВУ (61) Дополнительное к авт. сеид-ву (22) Заявлено 04.04.79(21) 2745594/18-24 с присоединением заявки ¹â€” (23) Приоритет

Опубликовано 2 310.80. Бюллетень "@ 39

Дата опубликования описания 25.10. 80 (51)М К„.з

6 11 С 11/00

Государственный комитет

СССР по делам изобретений и открытий (53) УДК 681. 327 (088.8) (72) Авторы изобретения

A. Н. Мельник, И. В. Бурковский, Я. М. Будовский и Г. Ф. Карпишпан (7! ) Заявитель (54) ЗАПОМИНАЮЩЕЕ УСТРОЙСТВО СО СЧИ1ЫВАНИЕМ

БЕЗ РАЗРУШЕНИЯ ИНФОРМАЦИИ

Изобретение относится к запоминающим устройствам.

Известно устройство, содержащее блок .управления, и запоминающих блоков с входными коммутационными 5 элементами, адресные и разрядные формирователи токов записи с выходными коммутационными элементами, которые подключены к входным коммутационным элементам одного из за- 10 поминающих блоков, и- -дешифратор запоминающих блоков (1) .

Недостатком этого запоминающего устройства является ограничение функциональных возможностей и невысокое быстродействие из-эа отсутствия режима автоматической перезаписи информации из одного массива адресов в другой.

Наиболее близким по технической 2О сущности к предлагаемому изобретению является запоминающее устройство без разрушения информации, содержащее регистр адреса, связанный с первыми, а через формирователи адрес- 25 ных токов записи и первый коммутатор - co вторыми входами и запоминающих блоков, третьи входы которых подключены через дешифратор базового адреса к первым выходам регистра 3О базового, адреса, а четвертые входы через второй коммутатор и формирова- тели разрядных токбв записи — к выходам регистра числа, выходы которого соединены с выхсдами запоминающих блоков, блок управления, первый вход которого связан с регистром установки массива адресов, второй с первым выходом блока задания режимов, а выход — с регистром базового адреса (2).

Недостатком этого запоминающего устройства является невысокое быстродействие из-эа отсутствия режима автоматической перезаписи информации из одного массива адресов в другой.

Цель изобретения — повышение быстродействия устройства за счет введения режима автоматической перезаписи информации из одного массива адресов в другой. Поставленная цель достигается тем, что в запоминающее устройство со считыванием без разрушения информации, содержащее накопители, блок управления, формирователь адресных токов записи, формирователь разрядных токов записи, два коммутатора, регистр адреса, регистр .базового адреса, .773724 дешифратор, регистр считывания, регистр записи, блок местного управления и регистр числа, причем первые и вторые входы накопителей соединены соответственно с первым входом формирователя адресных токов записи и выходом регистра адреса и с выходами первого коммутатора, третьи и четвертые входы накопителей подключены соответственно к выходам дешифратора и к выходам второго коммутатора, Вход первого коммутатора соединен с выходом формирователя адресных токов записи, второй вход которого подключен к пятым входам накопителей, первому выходу блока управления и первому входу формирователя разрядных токов записи, второй вход которого соединен с выходом регистра числа, а выход — со входом второго коммутатора, выходы накопителей подключены ко входу регистра числа, первый вход блока управления соединен с первым выходом блока местного управления, а второй выход †. co входом регистра адреса и первым входом регистра базового адреса, выход которого подключен ко входу дешифратора, введены третий коммутатор и блок переключения режимов, первый, второй и третий выходы которого соединены соответственно со вторым, третьим и четвертыми выходами блока местного управления, а первый, второй и третий выходы блока переключения режимов подключены соответственно ко второму, третьему и четвертому входам блока управления, первый и второй входы третьего коммутатора соединены соответственно с третьим и четвертым входами блока унравления, третий и четвертый входы — соответственно с выходом регистра считывания и с выходом регистра записи, выход третьего коммутатора подключен ко второму входу регистра базового адреса.

При этом блок переключения режимов целесообразно выполнить содержащим триггер, генератор импульсов, четыре элемента И, элемент НЕ и два элемента ИЛИ, причем выход генератора импульсов соединен со счетным входом триггера, нулевой и единичный выходы которого подключены соответственнЬ к первым входам первого и второго элементов И, первый вход треть го элемента И, первый вход четвертого элемента И, вторые входы первого и второго элементов И и вход элемента НЕ соединены соответственно с первым, вторым и тре тьим .входами блока переключения режимов,. выход элемента НЕ подключен ко вторы -: .-.одам третьего и четвертого элементов И, выходы первого и третьего элементов И соединены соответственно с первым и

5 !

О

20 вторым входами первого элемента ИЛИ выходы второго и четвертого элементов И, подключены соответственно к первому и второму входам второго элемента ИЛ!;, выходы генератора импульсов, первого и второго элементов ИЛИ соединены соответственно с первым, вторым и третьим выходами; блока переключения режимов, Третий коммутатор целесообразно выполнить содержащим пятый и шестой элементы И и третий элемент ИЛИ, причем выходы пятого, шестого элементов И подключены соответственно к первому и второму входам третьего элемента ИЛИ, выход которого соединен с выходом третьего коммутатора, первый и второй входы пятого элемента И подключены соответственно к первому и третьему входам, а первый и второй входы шестого элемента И вЂ” ко второму и четвертому входам третьего коммутатора.

На чертеже изображена принципиальная схема предложенного устройства.

25, Устройство содержит накопители

1„ — 1, блок 2 управления, формирователь 3 адресных токов, формирователь 4 разрядных токов записи, первый 5 и второй б коммутаторы,peg0 гистр 7 адреса, регистр 8 базового адреса, дешифратор 9, регистр 10 считывания, регистр 11 записи, блок 12 переключения режимов, блок 13 местного управления, третий коммутатор 14 и регистр 15 числа. Первые и вторые входы накопителей 1„ — 1„ соединены соответственно с первым входом формирователя 3 адресных токов записи и выходом регистра 7 адреса и с выходами первого комму40 татора 5. Третьи и четвертые входы накопителей 1„ — 1„ подключены соответственно к выходам дешифратора 9 и к выходам второго коммутатора б.

Вход первого коммутатора 5 соединен

45 с выходом формирователя 3 адресных токов записи, второй вход которого подключен к пятым входам накопителей, 1„- 1, первому выходу блока 2 управ-.. ления и первому входу формирователя 4

5Q разрядных токов записи, второй вход которого соединен с выходом регистра 15 числа, а выход — со входом второго коммутатора б. Выходы накопителей 1 - 1 подключены ко входу

11 регистра 15 числа. Первый вход блока 2 управления соединен с первым выходом блока 13 местного управления, а второй выход - co входом .регистра 7 адреса и первыми входами регистра 8 базового адреса, вы60 ход которого подключен ко входу де,шифратора 9. Первый, второй и. третий входы блока 12 .переключения режимов соединены соответственно со вторым третьим и четвертым выходами бло65 ка 13 местного управления. Первый, 773724 второй и третий выходы- блока 12 переключения режимов подключены соответственно ко второму, третьему и четвертому входам блока 2 управления. Первый и второй входы. третьего коммутатора 14 соединены соответственно с третьим и четвертым входами блока управления, третий и четвертый входы — соответственно с выходом регистра„10 считывания и с выходом регистра 11 записи. Выход третьего коммутатора 14 подключен ко второму входу регистра базового адреса 8.

Блок 12 переключения режимов содержит триггер 16, генератор импульсов 17, первый 18 и второй 19 элементы И, элементы НЕ 20, первый 21 и второй 22 элементы ИЛИ, третий 23 и четвертый 24 элементы И. Выход генератора 17 импульсов соединен со счетным входом триггера 16, нулевой и единичный выходы которого подключены соответственно к первым входам первого 18 и второго 19 элементов H.

Первый вход третьего элемента И 23, первый вход четвертого элемента И 24, вторые входы первого 18 и второго 19 элементов И и выход элемента НЕ 20 соединены соответственно с первым, вторым и третьим выходами блока 12 переключения режимов. Выход элемента НЕ подключен ко вторым входам третьего 23 и четвертого 24 элементов И. Выходы первого 18 и третьего 2 элементов И соединены соответственно с первым и вторым входами первого элемента ИЛИ 21. Выходы второго 19 и четвертого 24 элементов И подключены соответственно к первому и второму входам второго элемента ИЛИ 22.

Выходы генератора импульсов 17, пер- вого 21 и второго 22 элементов ИЛИ соединены соответственно с первым, вторым И третьим выходами блока переключения режимов 12. Коммутатор 14 содержит пятый 25 и шестой 26 элементы И и третий 27 элемент ИЛИ. Выходы пятого 25 и шестого 26 элементов И подключены соответственно к первому и второму входам третьего эле мента ИЛИ 27, выход которого соединен с выходом третьего коммутатора 14.

Первый и второй входы пятого элемента И 25 подключены соответственно к первому и третьему входам, а первый и второй входы шестого элемента И 26 ко второму и четвертому входам третье го коммутатора 14.

Устройство работает следующим обра зом.

Если блоком 13 местного управления установлен режим перезаписи, то с его второго выхода поступает потенциал разрешения в блок переключения режимо на вторые входы первого 18 и второго 19 элементов И и на вход элемента

HE 20, с выхода которого поступает потенциал запрещения на вторые вхо.— ды третьего 23 и четвертого 24 элементов И.

Под воздействием HMllóëüñop, посту. пающих с выхода генератора 17 импуль сов на счетный вход т :нггеоа 16, последний попеременно изменяет свое состояние. Изменяющ>:.эся ссстояния счетного триггера 16 поступают на

5 первые входы открытых элементов И

18 и 19. В результате в соо ветствии с состоянием триггера 16 через элементы ИЛИ 21 и 22 на четвертый и третий входы блока 2 управления поступают потенциалы, определяющие режим работы запоминающего устройства, т.е. режим считывания или записи. Эти же потенциалы поступают на первый и второй входы третьего комму15 татора 14. Таким образом, осуществляется автоматическое переключение режима работы запоминающего устройства.

Потенциал, определяющий режим считывания, поступает с выхода элемен2О та ИЛИ 21 на первый вход пятого элемента И 25, а потенциал, определяюющий режим записи, поступает с выхода элемента ИЛИ 22 на первый вход второго элемента И 26. Таким образом, в зависимости от режима работы открывается элемент И 25 или элемент

И 26. В результате через элемент

ИЛИ 27 на второй вход регистра базового адреса 8 поступает код одного иэ накопителей 1 — 1 „, установленный заранее на регистре 10 считыва3 ния и регистре 11 записи, и происходит поочередная выборка того из накопителей 1 — 1» из которого необходимо считать информацию, того

35 из накопителей 1 - 1,„ в который эту информацию надо записать.

Считанная из выбранного накопителя 1<- 1>,информация поступает на регистр 15 числа. После автомати4О ческого переключения с режима считывания на режим записи и выборки накопителя 1 — 1», в который необходкмо записать считанную информацию, по сигналам, поступающим со второго выхода блока 2 управления в соответствии с кодом числа, хранящимся в регистре 15 чис".а, сбрасывают формирователи разрядных токов записи 4, выходы которых соединены через разрядный коммутатор 6 с четвер тыми входами того иэ накопителей

1 - 1», в котором необходимо записать информацию, и происходит запись этого числа в выбранный накопитель.

Текущий адрес накопителей 1<- 1»вы55 рабатывается автоматически в регистре базового адреса 8 по сигналам, поступающим на его вход со второго выхода блока управления.

При этом регистр 7 блока работает в . в .счетном режиме.

Если в блоке 13 местного управления установлен режим "Считывание" или "Запись", то с его второго или третьего выходов соответственно по65 сТупает потенциал,. определяющий ре773724 жим, на первые входы третьего и четвертого элементов И 23 и 24, а с четвертого выхода блока 13 местного управления поступает потенциал .запрещения на вторые входы первого и второго элементов И 18 и 19 и через элемент НЕ 20 — потенциал разрешения на вторые входы третьего и четвертого элементов И 23 и 24. B результате на втором и третьем выходах блока 12 переключения режимов образуются потенциалы, определяющие режим работы н соответствии с установленным в блоке 13 местного управления.

Технико-экономическое преимущество предложенного устройства заключается н том, что оно обеспечивает автоматическое переключение режимов работы устройства совместно с коммутацией базового адреса и установ ку массива записи, что позволяет с большой скоростью и достоверностью перезаписывать информацию из одного накопителя н другой и, в результате, повысить быстродействие запоминающего устройства со считыванием без разрушения информации. Применение предложенного устройства для отладки программ в цифровых вычислительных .системах управления позволяет сократить время отладочных работ.

Формула изобретения

1. Эапоминающее устройстно со считыванием без разрушения информации, содержащее накопители, блок управления, формирователь адресных токов записи, формирователь разрядных токов записи, дна коммутатора, регистр адреса, регистр базового адреса, дешифратор, регистр считывания, регистр 40 записи, блок местного управления и регистр числа, причем первые и вторые входы накопителей соединены соответственно с первым входом формирователя адресных токов записи и 4$ выходом регистра адреса и с выходами первого коммутатора, третьи и четвертые входы накопителей подключены соответственно к выходам дешифраторон и к выходам второго коммутатора, вход 0 первого коммутатора соединен с вы. ходом формирователя адресных токов записи, первому выходу блока управления и первому входу формирователя раэ ряднья тОкОВ записи втОрОй ВХОД кО торога соединен с выходом регистра числа; а выход — co входом второго коммутатора, выходы накопителей подключены ко входу регистра числа, первый вход блока управления соединен с первым выходом блока местного 60 управления, а второй выход - со входом регистра адреса и первым входом регистра базового адреса, выход которого подключен ко входу дешифратора, о т л и ч а ю щ е е с я,тем, что, с 65 целью повышения быстродействия устройства, оно содержит третий коммутатор и блок переключения режимов, первый, . второй и третий входы которого соединены, соответственно, со вторым, третьим и четвертым выходами блока местного управления,а первый, второй и третий выходы блока переключения режимов подключены соответственно ко второму, третьему и .четвертому входам блока управления, первый и второй входы третьего коммутатора соединены соответственно с третьим и четвертым входами блока управления, третий и четвертый входы — соответственно с вы-, ходом регистра считывания и с выходом регистра записи, выход третьего коммутатора подключен ко второму входу регистра базового адреса.

2.устройство по п.1,о т л и ч а ющ е е с я тем,что блок переключения рехаг1ОВ содержит триггер, генератор импульсов, четыре элемента И,элемент НЕ и два элемента ИЛИ,причем выход генератора импульсов соединен со счетным входом триггера, нулевой и единичные вы-. ходы которого подключены соответственно к первым входам первого и второго элементов И, первый вход третьего элемента И, первый вход четвертого элемента И, вторые входы первого и второго элементов И и вход элемента ИЕ соединены соответственно с первым, со вторым и с третьим входами блока переключения режимов, выход элемента НЕ подключен ко вторым входам третьего и четвертого элементов И, ныходы первого и третьего элементов И соединены соответственно с первым и вторым входами первого элемента ИЛИ, выходы второго и четвертого элементов И подключены соответственно к первому и второму входам второго элемента ИЛИ, выходы генератора импульсов, первого и второго элементов ИЛИ соединены соответ стненно с первым, вторым и третьим выходами блока переключения режимов.

3. Устройство по пп.1 и 2,о т л ич а ю щ е е с я тем, что третий коммутатор содержит пятый и шестой элементы И и третий элемент ИЛИ, причем выходы пятого и шестого элементов И подключены соответственно к первому и второму входам третьего элемента ИЛИ, выход которого соединен с выходом третьего кожаутатора, первый и второй вхрды пятого элемента И подключены соответственно к первому и третьему входам, а первый и второй нходы шестого элемента И вЂ” ко второму и четвертому входам третьего коммутатора.

Источники информации, принятые во внимание при экспертизе

1. Климов И.И . и др. ПОлупостоян" ное заполняющее устройство на тороидальных магнитных сердечниках с

? 73724

Составитель Т.Зайцева

Редактор Г. Волкова Техред Н. Барадулина Корректор О. Билак

Заказ 7516/68 Тираж 662 Подписное

ВНИИПИ Государственного комитета СССР по делам изобретений и открытий, 113035, Москва, Ж-35, Раушская наб., д. 4/5 филиал ППП "Патент", г. Ужгород, ул. Проектная, 4 диаметральными отверстиями. — "Вопросы радиоэлектроники",сер.ЭВТ,1970, вып.56, с. 143-161.

2. Авторское свидетельство СССР по заявке У 2610769,кл. 2 G 11 С 17/0?1978 (прототип).