Устройство для сопряжения двух цифровых вычислительных машин

Устройство для сопряжения двух цифровых вычислительных машин

Иллюстрации

Показать все

Реферат

 

ОП ИСАЙЯМ

ИЗО6РЕТЕН ИЯ

К АВТОРСКОМУ СВИДЕТЕЛЬСТВУ

<»>868741 ч.оег Соввтсиих

Социалистицасва

Республик (61) Дополнительное к авт. свид-ву— (22) Заявлено 22.10.79 (21) 2830263/18-24 с присоединением заявки ЭЙ (23) Приоритет

{5l jM. Кл.

G 06 F 3/04

Гееударстеенюй ноинтет

СССР

Il0 денем нзееретеннй н еткрытнй

Опубликовано 30.09.81. Бюллетень № 36

Дата опубликования описания 30.09;81

{53) УДК 681.325 (088.8) I

>

В. Г. Петросов, Л. А. Старк и В. М. Вальков

1 (72) Авторы изобретения (71) Заявитель (54) УСТРОЙСТВО ДЛЯ СОПРЯЖЕНИЯ

ДВУХ ЦИФРОВЫХ ВЫЧИСЛИТЕЛЬНЫХ

МАШИН

Изобретение относится к вычислительной технике и может быть использовано в системах реального времени для организации обмена информации между двумя цифровыми вычислительными машинами (ЦВМ) .

Известны устройства, 1тйя сопряжения, двух

ЦВМ, содержащие блоки электрического согласования первой и второй ЦВМ, блоки входных и выходных элементов И, блок синхронизации, блок управления, блок регистров, блок формирования команд и блок хранения команд (1).

Недостаток этих устройств состоит в ограниченной области их применения.

Наиболее близким к предлагаемому о технической сущности является устройство для сопряжения двух вычислительных машин, содержащее узлы согласования выходных и входных сигналов информации и управления, соединенных с каналом первой ЦВМ, узел сравнения адресов, соединенный входом с выходом регистра адреса, буферный регистр, подключенный входом, через входной коммутатор к выходу второй ЦВМ, а выходом — ко входу выходного коммутатора, узел контроля по четности, регистр управления, соединенный выходами и входами с соответствующими выходами и входами второй ЦВМ и канала первой

ЦВМ и входами и выходами узлов согласования входных и выходных сигналов управления Р1.

Недостаток известного устройства состоит в ограниченной области его применения.

Цель изобретения — расширение области применения.

Поставленная цель достигается тем, что в устройство, содержащее регистр управляющего слова, выходом соединенный с первым входом первой цифровой вычислительной машины, первый выход которой подключен к первому входу блока сравнения адресов, соединенного вторым входом с выходом регистра адреса, и к первому входу блока контроля по модулю, первый выход которого соединен с первым входом триггера контроля, выходом соединенного с первым входом коммутатора, второй вход . которого подключен к первому выходу буферного регистра обмена, а выход — к первому входу второй цифровой вычислительной маши868741 4 ны, и блок формирования сигнала прерывания, выход которого подключен.ко второму входу второй цифровой вычислительной машины, введены блок анализа состояния, два блока формирования тактовых импульсов, группу элементов И, блок формирования сигналов направ-t ления обмена, блоки управления чтением и записью и элемент ИЛИ, причем первый вход и второй выход буферного регистра обмена подключены соответственно к первому и второму входам блока контроля по модулю, первый и второй входы блока анализа состояния соединены соответственно с первым и,вторым входами первого блока формирования тактовых импульсов, вторым выходом и первым входом первой цифровой вычислительной машины, второй вход которой соединен со вторым вьиодом блока контроля по модулю, третий и четвертыь входы которого подключены соответственно к первому и второму выходам блока анализа эо состояния, третий выход которого соединен с третьим входом блока сравнения адресов, четвертый и пятый — соответственно с первым и вторым входами регистра управляющего слова, а шестой и седьмой выходы — соответственно 25 с первыми входами элемента ИЛИ и блока формирования сигнала прерывания, вторым входом

1 подключенного к выходу блока управлейия чтением, третий вход коммутатора соединен с первым входом блока анализа состояния, третий вход регистра управляющего слова подключен к выходу элемента ИЛИ, вторым входом соединенного с выходом блока сравнения адресов, группа входов регистра управляющего слова подключена к выходам элементов И группы

35 и первым группам входов блоков управления чтением и записью, вторая группа входов которого соединена с первой группой входов регистра обмена, второй группой входов блока управления чтением и группой выходов блока форQQ мирования сигналов направления обмена, первый, второй и третий выходы второго блока формирования тактовых импульсов подключены соответственно к четвертому, пятому и шестому входам коммутатора, четвертый и пятый выходы — соответственно к первому и второму вха ф5 дам блок" формирования сигналов направления обмена, третий вход которого соединен со вторым входом буфернога регистра обмена, первыми входами элементов И группы и первым выходом второй цифровой вычислительной машины, второй выход которой подключен ко входу второго блока формирования тактовых импульсов, шестым выходом подключенного к первому входу блока управления записью,, седьмым выходом — ко вторым входам элементов

И группы, а пятым вьиодом — ко второму вхо ду триггера контроля, первый и второй выходы блока формирования сигналов направления обмена соединены соответственно с третьим и четвертым входами блока анализа состояния и первым и вторым входами блока управления чтением, а третий выход — с третьим входом первого блока формирования тактовых импульсов, первый выход которого подключен к третьему входу буферного регистра обмена, а второй выход — к третьему входу блока управления чтением, группа выходов которого соединена со второй группой входов буферного регистра обмена, четвертым входом соединенного с пятым входом блока анализа состояния и восьмым выходом второго блока формирования тактовых импульсов, а третьей группой входов — с группой,выходов блока управления записью, второй вход которого подключен ко второму выходу блока формирования сигналов направления обмена, седьмой вход коммутатора соединен с первым входом буферного регистра обмена.

При этом блок управления чтением содержит два шифратора, выходы которых являются группой выходов блока, первые входы соединены с первым входом первого и выходом второго элементов И, вторые входы — с выходом третьего элемента И, третьи входы — соответственно со вторым н первым входами i блока, а четвертые- входы — с выходом четвертого элемента И и первым входом первого элемента ИЛИ, второй вход и выход которого соединены соответственно с выходом первого элемента И и выходом блока, первые входы второго, третьего и четвертого элементов И подключены через элемент задержки к третьему входу блока, вторые выходы — к соответствующим выходам дешифратора, соединенного входом с вьиодом счетчика, вход и группа входов которого соединены соответственно с третьим .входом и первой группой входов блока, третьи входы второго и третьего элементов И подключены к выходу второго элемента ИЛИ, первый, второй, третий и четвертый входы которого подключены ко второй группе входов блока, третий вход четвертого элемента И соединен с выходом третьего элемента ИЛИ, входы которого подключены соответственно к первому, третьему и четвертому входам второго элемента ИЛИ.

Кроме того, блок управления записью содержит счетчик, группой входов и выходов со-. единенный соответственно с первой группой входов блока и входом дешифратора, а вхо. дом — с вьиодом первого элемента И и через элемент задержки — с первыми входами второго, третьего и четвертого элементов И, вто-. рые входы которых подключены coorsernseHно к выходам дешифратора, а третьи входы— соответственно к вьиоду и первому входу первого элемента ИЛИ и выходу второго элемента ИЛИ, входы первого элемента И явля868741 6 гера, а третий вход через четвертый элемент

НЕ соединен с первым входом седьмого элемента И и первым входом блока, первый вход второго триггера соединен с выходом седьмого элемента И и первым входом четвертого элемента ИЛИ, а второй вход — с выходом пятого элемента ИЛИ, непвым входом подключенного к выходу шестого элемента И, а вторым входом — ко второму входу четвертого элемента ИЛИ, входу сброса четвертого элемента

НЕ и пятому входу блока, второй вход седьмого элемента И подключен к выходу первого триггера, входы шестого элемента ИЛИ подключены к первому входу блока, а выход через второй элемент задержки соединен с четвертым выходом блока.

На фиг. 1 представлена блок-схема предлагаемого устройства; на фнг. 2 — функциональная схема блока анализа состояния.

Устройство (фиг. 1) включает канал 1 первой цифровой вычислительной машины, блоки 2 и 3 формирования тактовых импульсов, блок

4 управления записью, блок 5 управления чтением, буферный регистр 6 обмена, блок 7 ана-. лиза состояния, коммутатор 8, регистр 9 управ25 ляющего слова, блок 10 формирования сигналов прерывания, элемент ИЛИ 11, блок 12 формирования сигналов направления обмена, триггер 13 контроля, вторую (микро- или мини)

ЭВМ 14, блок 15 контроля по модулю, регистр 16 адреса и блок 17 сравнения адресов, Блок 5 управления чтением содержит шиф раторы 18 и 19, элементы И 20 — 23, элементы

ИЛИ 24, 25 и 26, элемент 27 задержки, счетчик 28 и дешифратор 29. Блок 4 управления записью содержит элементы И 30 — 33, элементы ИЛИ 34 и 35, счетчик 36, дешифратор 37. и элемент 38 задержки. Коммутатор 8 состоит из трех элементов И 39, 40 и 41 групп и группы элементов ИЛИ 42. Блок 12 формирования сигналов направления обмена включает элементы И 43 группы, два элемента И 44 и

45, два триггера 46 и 47 направления обмена, регистр 48 формата и элемент ИЛИ 49. ются соответственно первым и вторым входами блока, входы первого элемента ИЛИ подключены к соответствующим входам второй группы входов блока, входы второго элемента ИЛИ соединены соответственно с первым и вторым входами первого элемента ИЛИ, выходы второго, третьего и четвертого элементов И являются группой выходов блока.

Причем блок формирования сигналов направления обмена содержит группу элементов И, входы которых подключены соответственно к первому и третьему входам блока, а выходы— к информационным входам регистра формата, выходы которого являются группой выходов блока, а вход сброса подключен ко второму входу блока и входам сброса первого и второго триггеров направления обмена, информационными входами соединенных соответственно с выходами первого и второго элементов И, а, выходами — соответственно с первым и вторым входами элемента ИЛИ и вторым и первым выходами блока, первые входы первого и.второго элементов И соединены с первым входом блока, а вторые входы — с третьим входом блока.

Кроме того, блок анализа состояния содержит четыре элемента НЕ, семь элементов И, шесть элементов ИЛИ, два элемента задержки и два триггера, причем первый вход первого элемента И соединен с зыходом первого элемента НЕ, второй вход — с первым входом блока, а третий вход — с четвертым входом блока и первым входом первого элемента ИЛИ, .входы второго элемента И подключены соответственно к первому и третьему входам блока, второй вход первого элемента ИЛИ соединен с третьим входом блока, а выход — через второй элемент НЕ с первым входом третьего элемента И, выход которого соединен с одним входом второго элемента ИЛИ, а второй вход — 40 с первым входом блока, входы второго элемента ИЛИ подключены соответственно к первому входу блока, а выход является седьмым выходом блока, входы четвертого элемента И являются первым входом блока, а выход соединен со вторым выходом блока н первым входом третьего элемента ИЛИ, выход которого является шестым выходом блока, а второй вход соединен с выходом пятого элемента И, первый и второй входы которого под50 ключены соответственно к первому и второму входам блока, выходы первого и второго элементов И соединены соответственно с пятым и первым выходами блока, выход шестого элемента И через первый элемент задержки соединен с третьим выходом блока, первый вход через третий элемент НЕ соединен со вторым входом блока и первым входом первого .триггера, второй вход — с выходом второго тригВ составе устройства (фнг. 1) выделены элементы И 50 группы, а в составе ЦВМ 14— блок 51 прерываний, канал 52 и процессор 53.

Блок 7 анализа состояния (фиг. 2) содержит элементы И 54 — 60, элементы ИЛИ 61 — 66, элементы 67 и 68 задержки, элементы НЕ 69—

72, триггеры 73 и 74, входы 75-79 и выходы

80 — 86 блока..

Устройство работает следующим образом.

Устройство должно обеспечить связь универсальной ЦВМ-1 (например ЕС ЭВМ), находящейся на верхнем уровне сложной иерархической системы управления, и мини- микро ЭВМ

14, например 24-разрядной мини-ЭВМ "Электроника К-200", находящейся на нижнем уров68741 8!

ЗО

55

7 8 ,не этой системы управления. ЭВМ как верхнего, так и нижнего уровня могут инициировать обмен.

Мини- (микро) ЭВМ по отношению к универсальной ЭВМ можно рассматривать как активное внешнее устройство, поэтому операции

"ввод" или "вывод" означают соответствующую передачу информации по отношению к универсальной ЭВМ.

При описании работы устройства используется стандартная терминология обозначения сигналов, принятых в системе ЕС ЭВМ и изложенных в ОСТ 4 ГО 304.000.

1. Инициатор обмена ЦВМ-1; Ввод данных..

Общая тактика обмена в данном режиме предполагает первоначально передачу из IJBM-1 в мини-ЭВМ 14 сл лобной иноформации., которая характеризует предстоящими. обмен (определяет для мини-ЭВМ код операции обмена, область данных и т.д.), после чего выполняется передача массива данных. Всякая передача информации подразделяется на три этапа: вхождение в связь, передача данных и выход из связи.

1. Вхождение в связь.

ЕС ЭВМ как инициатор обмена начинает вы борку устройства и мини-ЭВМ 14. Сигналы начальной выборки интерфейса ввода-вывода (РАБ — К, ВБР— К, АДР— К) поступают с выхода канала 1 (выходная управляющая шина интерфейса ввода-вывода, ШИН УПР— К) 11а первый вход блока 7. При этом сигнал с выхода элемента И 57 поступает на второй вход блока 17. В этот же момент с первого выхода канала 1 (выходная информационная шина интерфейса ввода-вывода EC ЭВМ, ШИН вЂ” К) на второй вход блока 17 поступает код адреса.

Если при этом происходит сравнение адресов, то на выходе блока 17 появляется сигнал, устанавливающий через элемент ИЛИ 11 регистр

9 в состояние, соответствующее подключенному устройству.

Одновременно в блоке 7 входной сигнал

ВБР— К (четвертая шина первого входа) поступает через элемент ИЛИ 62 на первый вход бло ка 10, который формирует сигнал, прерывающий работу мини-ЭВМ и информирующий по. следнюю и требовании обмена со стороны ЕС

ЭВМ. По данному сигналу прерывания мини- ЭВМ через канал. 52 выдает информацию адреса, которая поступает на второй вход буферного регистра 6, а также управляющие сигналы, которые поступают в блок 3. С выхода блока 3 выдается тактовый управляющий сигнал на вход буферного регистра 6, что обеспечйвает запоминание в буферном регистре адреса.

После этого мини-ЭВМ через канал 52 выдает на вход блока 3 управляющие сигналы, а на вход группы элементов И 50 — управляющую информацию. По сигналу блока 3 управ ляющая информация проходит в регистр 9 и переводит последний в состояние, соответствующее выдаче в канал 1 сигнала запроса на передачу информации адреса. Блок 2 генерирует управляющий тактовый сигнал на третий вход буферного регистра 6, в результате чего байт служебной информации (в данном случае адрес) передается через блок 15, где формируется контрольный разряд по нечетности на вход канала 1 (входная информационны шина интерфейса ввода-вывода EC ЭВМ, ШИН вЂ” А).

В ответ на выходной сигнал регистра 9 канал 1 генерирует новое состояние выходных управляющих шии (УПРК вЂ” 1 на пятой шине первого входа блока 7). Сигнал, который через элемент ИЛИ 62 поступает в блок 10, вызьвает прерьвание мини-ЭВМ. По данному сигналу прерывания на первом выходе канала 52 появляются управляющие сигналы, которые поступат на вход блока 3, в результате чего на выходе этого блока появляется разрешающий сигнал на элементы И 41. Код команды обмена, который в этот момент поступает с выхода канала на другие входы элементов И 41, через элементы ИЛИ 42 выдается на вход канала 52. Далее мини-ЭВМ через канал 52 и элементы И 50 снимает запрос на передачу адреCR.

Аналогично передаче адреса мини-ЭВМ осуществляет передачу байта состояния в буферньй регистр 6, но переводит регистр 9 в состояние, соответствующее запросу на передачу в канал байта состояния. Поступая на вход блока 2, этот сигнал вызывает на первом выходе генерацию тактирующего сигнала дпя пе4 редачи байта состояния в канал 1. В ответ на сигнал запроса передачи байта состояния канал 1 изменяет состояние выходных управляющих шин, на одной из которых появляется единичный потенциал (ИНФ вЂ” К), свидетельствующий о приеме каналом байта состояния.

Указанный сигнал (ИНФ вЂ” К, 71 a) поступает по первой шине первого входа блока 7 наэлемент ИЛИ 66 и через элемент задержки 68 проходит на третий вход регистра 9, который. переходит в состояние снятия запроса на передачу байта состояния (УПРА: = О). При поступленйи указанного сигнала из канала 1. на вход блока 2 заканчивается генерация тактирующего сигнала на первом выходе блока 2. Одновременно состояние выходной управляющей шины канала 1 (ИНФ вЂ” К) поступает на второй вход элемента И 62, на другом входе которого в этот момент имеется разрешающий сигнал эле; мента НЕ 70, вход которого соединен с выходом элемента ИЛИ 61, запрещенного по обоим входам, так как триггеры 46 и 47 находятся в исходном нулевом состоянии. Выходной сигнал элемента И 56 через элемент ИЛИ 62 поступает в блок 10, на выходе которого появ15

9 86874 ляется ситнап, прерывающий работу мини-ЭВМ.

По сигналу прерывания мини-ЭВМ генерирует на выходах канала управляющие сигналы и управляющую информацию, которая через элементы И 50 поступает на вход регистра 9, в результате чего последний переходит в состояние, соответствующее отключенному устройству от канала 1 (РАБ — А . = О).

Сопрягаемые ЦВМ оказываются расчлененными и могут осуществлять связь с,другими устройствами системы.

2. Передача данных.

Для передачи слова данных мини-ЭВМ на выходах канала 52 генерирует управляющие сигналы и управляющую информацию, которая поступает на вход регистра 9, в результате чего последний переводится в состояние, соответствующее запросу устройства в канала 1 на передачу байтов данных (ТРБА:=1). Указанный сигнал с выхода регистра 9 открывает по второму входу элемент И 58. В ответ на укаэанный сигнал канал 1 изменяет состояние выходных управляющих шин, информация о котором в виде единичного сигнала поступает на первый вход элемента И 58. В результате

25 на выходе этого элемента появляется сигнал, который через элемент ИЛИ 63 поступает на первый вход элемента ИЛИ 11. Выходной сигнал элемента ИЛИ 11 переводит регистр 9 в состояние, соответствуюшее устройству, подключенному к каналу 1 (РАБА: = 1) . Одновремензо но через элемент ИЛИ 62 на вход блока 10 поступает сигнал, по которому на выходе блока 10 появляется выходной еигнал, информирующий мини-ЭВМ о подключении устройства к каналу 1.

По сигналу прерывания мини-ЭВМ, генериВ руя управляющие сигналы и управляющую информацию, через канал 52 снимает запрос на передачу байтов данных в регистре 9 (ТРБА:=О), передает в буферный регистр 6 код адреса и, 4о устанавливает запрос иа передачу адреса в канал 1 (АДРА: = 1). В ответ на этот сигнал канал 1 изменяет состояние выходных управляющих шин, информация о котором через блоки 7 на выходе блока 10 генерирует сигнал, 45 прерывающий работу мини-ЭВМ. По сигналу прерывания мини — ЭВМ через канал 52 снимает запрос на передачу адреса.

Далее мини-ЭВМ генерирует на.одном иэ выходов канала 52, соединенном со входом блока 3, упрйвляющие сигналы таким образом, что ив четвертом выходе блока 3 появляется управляющий тактирующий сигнал, который переписывает p

ЭВМ и выполняемой операции обмена. В соот1 10 ветствии с выходными сигналами регистра 48 и триггеров 46 н 47 устройство организует согласование (приведение) форматов сопрягаемых

ЭВМ, т.е. адаптация устройства под конкретную мини- (микро-) ЭВМ осуществляется самой же мини- (микро-) ЭВМ.

Например, при операции ввода и разрядности подключенной мини-ЭВМ, равной 24, после укаэанной выше операции триггер 46 находится в единичном состоянии. Кроме того, активен также один (четвертый) из выходов регистра 48, указываюший на необходимость преобразования

24-разрядного формата в байтовыи. Г этого момента на выходе элемента ИЛИ 49, соединенного по входам с выходами триггеров 27 и 28, появляется потенциальный сигнал, который поступает на третий вход блока 2, блокируя выдачу сигнала с первого выхода блока 2 и разрешая выдачу сигнала нэ. третий вход блока 5.

Кроме того, выходной (единичный) сигнал триггера 27 блокирует элемент И 56 через элементы ИЛИ 61 и HE 70. В результате на время передачи данных запрещается прохождение через элементы И 56 н ИЛИ 62 иа вход блока 9, что свидетельствует о получении каналом 1 байта данных (сигнал квитирования, ИНФ вЂ” К).

Устройство осушествляет передачу байтов данных в блок-мультиплексном режиме, т.е. упаковка и распаковка одного блока, равного длине слова мини- (микро-) ЭВМ, выполняются без вмешательства ЭВМ. Это обеспечивается блоками 4 и 5 управления записью и чтением буферного регистра 6. Процедура состоит в следукнцем. Мини-ЭВМ по одному из выходов канала 52 генерирует управляющие сигналы, которые сопровождаюг 24-разрядные слова дан-. ных, выставляемые по другому выходу кана ла 52, соединенному с одним из входов буферного регистра 6, В результате поступления управляющих сигналов на вход блока 3 на шестом выходе последнего и входе элемента И 30 появляется тактирующий сигнал. На другом входе этого элемента с выхода триггера 46, находяшегося в единичном состоянии, имеется разрешающий сигнал, Сигнал с выхода элемента И 30 поступает в качестве счетного импульса на вход счетчика 36 и на вход элемента 38 задержки. Состояние счетчика 36 дешифруется дешифратором 37, в результате чего элемент

И 33 возбуждается сигналом с выходов дешифратора 37, элемента 38 задержки и элемента

ИЛИ 34. В результате на выходе элемента И

33 формируется сигнал, который поступает по третьей rpymie входов в качестве управляющего сигнала в буферный регистр 6, в результате чего в последний записывается 24-разрядное слово.

Далее мини-ЭВМ через канал 52 и элементы

И 50 переводит регистр в состояние запроса канала 1 на передачу одного байта информа868741 12

4о

11 ции (ИнФА: = 1). Указанный сигнал поступает в блок 2, в результате чего на втором его входе, соединенном со входами счетчика 28 и элемента 27 задержки, генерируется тактовый сигнал. В ответ на сигнал-запрос передачи байта данных канал 1 изменяет состояние выходных управляющих шин таким образом, что на одной из них появляется единичный потенциал — сигнал ответа канала на передачу байта данных (ИНФ вЂ” К). Информация состояния выходных управляющих шин передается в блок 2 и блок 7. По указанному сигналу заканчивается генерация выходного тактового импульса блока 2. Одновременно в блоке 7 этот же сигнал через первый вход логического элемента ИЛИ 66 поступает на элемент 68 задержки, выходной сигнал которого поступает на третий вход регистра 9, в результате .его в последнем снимается запрос на передачу одного байта данных (ИНФА: = О).

Выходной тактовый сигнал блока 2 в качестве счетного импульса поступает на вход счетчика 28 и элемент 27 задержки. Состояние счетчика дешифрируется дешифратором 29 и разрешает выдачу сигнала на выходе элемента

И 21. Выходной сигнал элемента И 21 поступает на первые входы шифраторов 18 и 19.

При этом шифратор 18 стробирован сигналом с выхода триггера 46, в то время как шифратор 19 блокирован. В результате на одном из выходов шифратора 18, соединенном с соответствующим входом буферного регистра 6, появляется сигнал, по которому первый байт информации с выхода буферного регистра 6 через блок 15 поступает на входную информационную шину. Таким образом, осуществляется передача 1-го байта 24-разрядного слова миниЭВМ. Сигнал запроса на передачу байта данных, поступающих в канал 1 с одного из выходов регистра 9 (ИНФА: = 1), одновременно поступает в блок 7 на первый вход триггера 73.

В результате элемент И 60 открывается и при поступлении на другой его вход сигнала квитирования из канала 1 на выходе появляется сигнал, который устанавливает триггер 74 в единичное состояние и переводит через элемент

ИЛИ 64 в нулевое состояние триггер 73 (триггер 73, эл менты И 60 и ИЛИ 64 образуют формирователь). Элемент И 59 оказывается открытым по второму входу.

В момент отсутствия сигнала запроса на передачу байта данных, поступающего из регистра

9 (ИНФА: = О), и отсутствия сигнала квитирования канала 1 (ИНФК: = О) первый и третий входы элемента И 59 оказываются также открытыми. Импульс с выхода элемента И 59 через элемент ИЛИ 65 переводит триггер 74 в исходное состояние (триггер 74, элементы

И 59 и ИЛИ 65 образуют формирователь). Выходной импульс элемента И 59 через элемент

1О

25 зо

67 задержки в качестве выходного сигнала блока 7 поступает в регистр 9 и переводит его в состояние запроса канала" 1 на передачу следующего (второго) байта данных (ИНФА: = 1).

Рассмотренная логика работы блока 7 позволяет повторно генерировать импульсы установки запроса на передачу данных в канал 1 при наличии первоначально программно-установленного запроса. С выхода элемента И 22 импульсы поступают на вторые входы шифратора 18, в результате чего на выходе шифратора генерируется управляющий сигнал, по которому передается в канал 1 2-ой байт информации. 3-ий байт информации передается при появлении на одном из входов шифратора 18 выходного сигнала логического элемента И 23, который по одному из входов разрешается выходным сигналом элемента ИЛИ 26, входы которого соединены с, выходами регистра формата, единичное состояние которых указывает на обработку соответственно 8-, 12- и 24-разрядных слов мини(микро-) ЭВМ. Выходной сигнал логического элемента И 23 через элемент ИЛИ 24 поступает на вход блока 10, в результате чего работа мини-ЭВМ прерывается. По сигналу прерывания мини-ЭВМ через канал 52 и элементы И 50 переводит регистр 9 в состояние, соответствующее отключению устройства от канала 1 (РАБА: = О). При этом счетчики 28 и 36 переходят в исходное (нулевое) состояние. После отключения от канала 1 устройство ждет со стороны мини-ЭВМ нового асинхронного сигнала для передачи очередного слова данных, т.е. перевода регистра 9 в состояние, соответствующее запросу, в канал 1 на передачу байтов данных.

3. Выход из связи.

Окончание передачи данных и выход из связи может производиться как по инициативе универсальной ЭВМ, так и по инициативе миниЭВМ, Если инициатива окончания передачи данных принадлежит ЕС ЭВМ, то после очередной распаковки и передачи 24-разрядного слова выходная управляющая шина канала 1 переходит в такое состояние, которое, указывает миниЭВМ на окончание передачи данных (УПРК:=1), Информация об этом состоянии в виде единичного сигнала (71д) поступает через пятую шину первого входа и элемент ИЛИ 62 в блок

10, что вызывает прерывание работы мини-ЭВМ.

По данному сигналу прерывания мини-ЭВМ через канал 52 и элементы И 50 переводит устройство в состояние отключения от канала 1 (РАБА: = О). Кроме того, через элементы И

44 и 45 мини-3ВМ переводит в исходное (нулевое) состояние регистр 48 формата и триггеры 46 и 47. Далее мини-ЭВМ переходит к выдаче стандартных байтов (или байта) состояния окончания обмена. Для этого мини-ЭВМ

86874 устанавливает связь на передачу байта состояния с каналом 1, как и в случае передачи байта данных. После прерывания работы по сигналу, поступающему от канала 1, мини-ЭВМ через канал 52 выдает в блок 3 управляющие сигналы и байт состояния с признаком окончания обмена, который поступает на один из входов буферного регистра 6. Выходной сигнал блока 3 осуществляет запись байта состояния в буферньгй регистр 6. Далее мини-ЭВМ через канал 52 и элементы И 50 переводит регистр

9 в состояние запроса канала 1 на передачу байта конечного состояния (УПРА: = 1), что вызывает генерацию на выходе блока 2 управляющего тактирующего сигнала (66), осуществляющего передачу байта конечного состояния из буферного регистра 6 через блок 15 на один иэ входов (входная информационная шина) канала 1. По окончании передачи конечного байта состояния или нескольких коне"ных байтов состояний считается, что операция ввода завершена. Выход из связи по инициативе мини-ЭВМ происходит аналогично, за исключс нием того, что это осуществляется на одном иэ тактов передачи слова данных, когда вместо очередного слова данных мини-ЭВМ передает байт конечного состояния.

Следует отметить, что на каждый сигнал прерывания мини-ЭВМ через канал 52 генерирует управляющие сигналы, которые вызывают появление на выходе блока 3 управляющих так30 тирующих сигналов, которые открывают элементы И 40, в результате чего информация о состоянии выходных управляющих шин кана- ла 1 и триггера 13, регистрирующего некорректность информации, передается для анали- 35 за через элементы ИЛИ 42 в канал 52.

40

50 данных.

При передаче третьего байта данных элемент

И 23 открывается выходным сигналом элемента ИЛИ 26, входы которог.1 подключены к выходам регистра 23 и на одном из которьпг в данный момент находится единичный потенциал, свидетельствующий о преобразовании байтовой информация в 24-разрядное слово дан55

II. Инициатор обмена ЕС ЭВМ. Вывод данных.

При выполнении операции "выход" этапы вхождения в связь и выхода из связи выиолняются аналогично onepauw "ввод", Процедура передачи данных осуществляется следующим образом.

После установления связи с каналом 1 на передачу байтов данных мини-ЭВМ получает сигнал прерывания, свидетельствующий, что такая связь установлена. По данному сигналу прерывания указанным способом осуществляется настройка устройства со стороны мини-ЭВМ на выполнение операции "вывод" с заданными форматами, в данном случае это преобразование байтов в 24-разрядное слово данньгх миниЭВМ. В результате один из выходов регистра

48, указывающий на 24-разрядный формат,:активен, триггер 12 находится в единичном состоянии. Далее мини-ЭВМ через канал 52 и элементы И 50 переводит регистр 9 в состояние, соответствующее запросу канала 1 на передачу одного байта информации (ИНФА: = 1).

1 14

Указанное состояние регистра 9 передается на входы канала 1, блока 7 и блока 2. В ответ канал 1 изменяет состояние выходных управляющих шин (ИНФО:=1), информация о кото ° ром поступает на входы блока 2 и блока 7. в результате чего на выходе блока 2 появляется управляющий тактирующий сигнал, который поступает на входы счетчика 28 и элемента 27 задержки. При этом счетчик 28 переводится в единичное состояние. После дешифрации состояния счетчика дешифратором 29 элемент И

21, открытый сигналами на других, формирует сигнал на первых входах шифраторов 18 и 19.

При этом шифратор 19 по одному из входов разрешен выходным сигналом триггера 47, а шифратор 18 запрещен выходным сигналом триггера 46, так.<ак осуществляется операция

"вывод".

В результате на одном из выходов шифратора 19 появляется сигнал, который поступает на один из входов буферного регистра 6 и переписывает в него с выходных информационных шин канала 1 первый байт данных. Блок

7 обрабатывает сигналы запроса и ответа аналогичным образом. Выходной сигнал блока 7 поступает на один из входов регистра 9 и снимает запрос на передачу байта данных. Указанное состояние регистра 9 управляющего слова передается на входные управляющие шины канала l, в результате чего канал 1 изменяет состояние выходньгх управляющих шин (ИНФК:

=О), а блок 7, регистрируя исходное состояние, вырабатывает сигнал, поступающий на вход регистра 9, и переводит последний в состояние, соответствующее запросу устройства на передачу очередного байта данных (ИНФА:=1). Передача в буферный регистр 6 второго и третьего байтов данных осушествляется аналогичным .образом. Отличие состоит в том, что счетчик

28 последовательно переходит в состояние, в результате чего по одним из входов последовательно открываются элементы И 22 и 23.

По другим входам эти элементы открыты выходным сигналом элемента 27 задержки. По третьему входу логический элемент И 22 открыт выходным сигналом элемента ИЛИ 25.

Выходной сигнал элемента И 22 поступает на второй вход шифратора 19, в результате чего на выходе последнего появляется управляющий сигнал, который поступает на вход буферного регистра 6 и переписывает в него второй байт

30

45

15 8 ных мини-ЭВМ. Выходной сигнал элемента И

23 появляется на третьем входе шифратора 19> что приводит к появлению на выходе последнего управляющего сигнала, поступающего в буферный регистр 6 для переписи с выходных информационных шин канала 1 третьего байта данных.

Одновременно выходной сигнал элемента И

23 через элемент ИЛИ 24 поступает на второй вход блока 10, в результате чего на выходе последнего появляется сигнал, прерываинций работу мини-ЭВМ. По данному сигналу прерывания мини-ЭВМ, через канал 52 генерирует управляющие сигналы, которые поступают на вход блока 3, который открывает элементы

И 39, и упакованная информация с одного из выходов буферного регистра 6 черсэ элсменты

И 39 и элементы ИЛИ 42 поступает на вход канала 52, после чего цикл передачи слова в мини-ЭВМ может быть повторен.

П!. Инициатор обмена мини-ЭВМ.

При выполнении операций ввода-вывода по инициативе мини-ЭВМ универсальная ЭВМ периодически выполняет специальную диагностическую операцию (в терминологии ЕС ЭВМ:

"Проверить ввод-вывод" ). Через устройство в мини-3ВМ пересылается указанная диагностическая команда, в соответствии с которой организуется передача в универсальную ЭВМ служебной информации запроса (в системе ЕС

38M — это байт состояния "Внимание")а, Принятый байт служебной информации эаппоса ан лизируется операционной системой ЕС ЭВМ, пос-. ле чего со стороны ЕС ЭВМ начинается выполнение команд ввода-вывода, которая обеспечивает передачу необходимого массива служебной информации в ЕС ЭВМ, в котором содержится требование мини-ЭВМ выполнить ту или иную. операцию ввода-вывода над тем или иным массивом данных. По окончании передачи массива служебной информации ЕС ЭВМ выполняет затребованную операцию обмена со стороны мини-ЭВМ. Техническая реализация такой тактики с помощью предлагаемого устройства по существу не отличается от реализации операций ввода-вывода данных по инициативе ЕС ЭВМ.

1У. Выполнение операций ввода-вывода с произвольной мини- (микро-) ЗВМ.

Устройство позволяет организовать связь и передачу данных между универсальной ЭВМ (например типа ЕС ЭВМ) и рядом произвольных мини-(микро-) ЭВМ. Разрядность шин данных интерфейса ввода-вывода современных мини-(микро-) ЭВМ, как правило, имеет следующие значения: 8, 12, 16 и 24. Поэтому, исходя иэ практической направленности, а такг же соображений минимизации аппаратуры, устройство обеспечивает передачу информации межrnid Rnnunnk 38M и мини- (микоо-.) ЭВМ с од

68741 16 ним из указанных форматов. При работе какойлибо конкретной пары ЭВМ устройство легко адаптируется модульным сокращением буферного регистра 6 обмена, что приводит к минимизации оборудования. При этом предполагается, что сопрягаемые ЭВМ для связи с внешними устройствами имеют системы прерываний.

Рассмотрим кратко особенности работы предлагаемого устройства при сопряжении универсальной ЭВМ (например ЕС ЭВМ) с мини-(микро-) ЭВМ, имеющими разрядность шин данных интерфейса ввода-вывода, отличную от 24.

Если формат данных мини-(микро-)ЭВМ равен 8, то мини-(микро-) ЭВМ через регистр

9 настраивает устройство таким образом, что после появления управляющего сигнала на одном иэ выходов шифратора 18 в случае операции ввода информации в ЕС ЭВМ или иа одном иэ выходов шифратора 19 в случае операции выводе информации из ЕС ЭВМ одновременно с передачей первого байта данных элемент И

20 оказывается открытым, выходными сигналами и соответствующим выходом регистра 48, который соответствует 8-разрядному формату шин данных интерфейса ввода-вывода мини(ми